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参数资料
| 型号： | WBLXT9785HCD0 |
| 厂商： | CORTINA SYSTEMS INC |
| 元件分类： | 网络接口 |
| 英文描述： | DATACOM, INTERFACE CIRCUIT, PQFP208 |
| 封装： | ROHS COMPLIANT, PLASTIC, HQFP-208 |
| 文件页数： | 33/234页 |
| 文件大小： | 3982K |
| 代理商： | WBLXT9785HCD0 |
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LXT9785 and LXT9785E Advanced 8-Port 10/100 Mbps PHY Transceivers
128
Datasheet
Document Number: 249241
Revision Number: 010
Revision Date: 30-May-2006
Intel recommends that a minimum recovery time be allowed after bringing up a port from software
or hardware reset. The recovery times are specified in Table 80, “Power-Up Timing Parameters” on
4.5.5
Hardware Configuration Settings
The LXT9785/LXT9785E provides a hardware option to set the initial device configuration. The
hardware option uses three Global CFG pins that provide control for all ports (see Table 42).
4.6
Link Establishment
4.6.1
Auto-Negotiation
The LXT9785/LXT9785E attempts to auto-negotiate with its link partner by sending Fast Link
Pulse (FLP) bursts. Each burst consists of 33 link pulses spaced 62.5
μs apart. Odd link pulses
(clock pulses) are always present. Even link pulses (data pulses) may also be present or absent to
indicate a “1” or a “0”. Each FLP burst exchanges 16 bits of data, referred to as a “page”. All
devices that support auto-negotiation must implement the “Base Page”, defined by IEEE 802.3
(registers 4 and 5). The LXT9785/LXT9785E also supports the optional “Next Page” function
(registers 7 and 8).
4.6.1.1
Base Page Exchange
By exchanging Base Pages, the LXT9785/LXT9785E and its link partner communicate their
capabilities to each other. Both sides must receive at least three identical base pages for negotiation
to proceed. Each side finds their highest common capabilities, exchange more pages, and agree on
the operating state of the line.
Table 42. Global Hardware Configuration Settings
Desired Mode
CFG
Pin Settings
1
Resulting Register Bit Values
AutoNeg
Speed
Duplex
1
2
3
0.12
0.13
0.8
4.8
4.7
4.6
4.5
Disabled
10
Half
Low
0
N/A
Auto-Negotiation
Advertisement
Full
High
Low
High
1
100
Half
Low
High
Low
1
0
Full
High
1
Enabled
100
Half
High
Low
1
10
0
1
00
Full/Half
High
Low
High
1
0
1
10/100
Half
High
Low
1
0
1
0
1
Full/Half
High
1
0
1
1. Refer to Table 5, “RMII Signal Descriptions – PQFP” on page 35 through Table 17, “Receive FIFO Depth
Considerations” on page 49 Table 24, “RMII Signal Descriptions – BGA23” on page 81 through Table 36,
Descriptions” on page 108 for CFG pin assignments.
相关PDF资料 |
PDF描述 |
|---|---|
| WBLXT9785HEC2V | DATACOM, INTERFACE CIRCUIT, PQFP208 |
| WBLXT9785HED0 | DATACOM, INTERFACE CIRCUIT, PQFP208 |
| WE128K16-150CM | 128K X 16 EEPROM 5V MODULE, 150 ns, CDMA40 |
| WE128K16-150CQA | 128K X 16 EEPROM 5V MODULE, 150 ns, CDMA40 |
| WE128K16-250CC | 128K X 16 EEPROM 5V MODULE, 250 ns, CDMA40 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| WBLXT9785HE.D0-865114 | 制造商:Cortina Systems Inc 功能描述:PHY 8-CH 10Mbps/100Mbps 208-Pin PQFP |
| WBM-DATA | 制造商:Thomas & Betts 功能描述: |
| WBM-DISHWASH | 制造商:Thomas & Betts 功能描述: |
| WBM-DISPOSAL | 制造商:Thomas & Betts 功能描述: |
| WBM-DUPLEX | 制造商:Thomas & Betts 功能描述: |
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