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参数资料
| 型号： | WBLXT9785HCD0 |
| 厂商： | CORTINA SYSTEMS INC |
| 元件分类： | 网络接口 |
| 英文描述： | DATACOM, INTERFACE CIRCUIT, PQFP208 |
| 封装： | ROHS COMPLIANT, PLASTIC, HQFP-208 |
| 文件页数： | 174/234页 |
| 文件大小： | 3982K |
| 代理商： | WBLXT9785HCD0 |
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LXT9785 and LXT9785E Advanced 8-Port 10/100 Mbps PHY Transceivers
44
Datasheet
Document Number: 249241
Revision Number: 010
Revision Date: 30-May-2006
83
K1
AMDIX_EN
I, ST, IP
Auto MDIX Enable Default.
This pin is read at startup or reset. Its value at that time
is used to set the default state of Register bit 27.9 for
all ports. These register bits can be read and
overwritten after startup / reset. Refer to Table 40 on
When active (High), automatic MDI crossover (MDIX)
(regardless of segmentation) is selected for all ports.
When inactive (Low) MDIX is selected according to the
MDIX pin.
59
D2
MDIX
I, ID, ST
MDIX Select Default.
This pin is read at startup or reset. Its value at that time
is used to set the default state of Register bit 27.8 for
all ports. These register bits can be read and
overwritten after startup / reset. Refer to Table 40,
When AMDIX_EN is active this pin is ignored.
When AMDIX_EN is inactive, all ports are forced to the
MDI or the MDIX function regardless of segmentation.
If this pin is active (high), MDI crossover (MDIX) is
selected. If this pin is inactive, non-crossover MDI
mode is set.
This pin is shared with RMII-RxER0. An external pull-
up resistor (see applications section for value) can be
used to set MDIX active while RxER0 is three-stated
during H/W reset. If no pull-up is used, the default
MDIX state is set inactive via the internal pull-down
resistor. Do not tie this pin directly to VCCIO (vs. using
a pull-up) in non-RMII modes.
85
86
87
L2,
L3,
M1
CFG_3
CFG_2
CFG_1
I, ST, ID
Global Port Configuration Defaults 1-3.
These pins are read at startup or reset. Their value at
that time is used to set the default state of register bits
Settings” on page 128 for all ports. These register bits
can be read and overwritten after startup / reset.
When operating in Hardware Control Mode, these pins
provide configuration control options for all the ports
(refer to page 128 for details).
173
M14
G_FX/TP_L
I, ST, ID
Global FX/TP_L Enable Default.
This pin is read at startup or reset. Its value at that time
is used to set the default state of Register bit 16.0 for
all ports. These register bits can be read and
overwritten after startup / reset. Refer to Table 92, “Port
This input selects whether all the ports are defaulted to
TP vs. FX mode.
Table 13. Miscellaneous Signal Descriptions – PQFP (Sheet 3 of 4)
Pin/Ball
Designation
Symbol
Type1
Signal Description2
PQFP
PBGA
1. Type Column Coding: I = Input, O = Output, OD = Open Drain Output, ST = Schmitt Triggered Input, TS =
Three-State-able Output, SL = Slew-rate Limited Output, IP = Weak Internal Pull-Up, ID = Weak Internal
Pull-Down.
2. The IP/ID resistors are disabled during hardware power-down mode.
3. The LINKHOLD ability is available only for stepping 4 (Revision D0).
相关PDF资料 |
PDF描述 |
|---|---|
| WBLXT9785HEC2V | DATACOM, INTERFACE CIRCUIT, PQFP208 |
| WBLXT9785HED0 | DATACOM, INTERFACE CIRCUIT, PQFP208 |
| WE128K16-150CM | 128K X 16 EEPROM 5V MODULE, 150 ns, CDMA40 |
| WE128K16-150CQA | 128K X 16 EEPROM 5V MODULE, 150 ns, CDMA40 |
| WE128K16-250CC | 128K X 16 EEPROM 5V MODULE, 250 ns, CDMA40 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| WBLXT9785HE.D0-865114 | 制造商:Cortina Systems Inc 功能描述:PHY 8-CH 10Mbps/100Mbps 208-Pin PQFP |
| WBM-DATA | 制造商:Thomas & Betts 功能描述: |
| WBM-DISHWASH | 制造商:Thomas & Betts 功能描述: |
| WBM-DISPOSAL | 制造商:Thomas & Betts 功能描述: |
| WBM-DUPLEX | 制造商:Thomas & Betts 功能描述: |
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