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参数资料
| 型号： | WJLXT971ALE.A4-857346 |
| 厂商： | CORTINA SYSTEMS INC |
| 元件分类： | 网络接口 |
| 英文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封装： | 10 X 10 MM, 1.40 MM HEIGHT, ROHS COMPLIANT, LQFP-64 |
| 文件页数： | 28/80页 |
| 文件大小： | 931K |
| 代理商： | WJLXT971ALE.A4-857346 |
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Page 34
Cortina Systems LXT972A Single-Port 10/100 Mbps PHY Transceiver
LXT972A PHY
Datasheet
249186, Revision 5.2
13 September 2007
5.6 MII Operation
5.6.7.1
Operational Loopback
Operational loopback is provided for 10 Mbps half-duplex links when register bit 16.8
= 0. Data that the MAC (TXData) transmits loops back on the receive side of the MII
(RXData).
Operational loopback is not provided for 100 Mbps links, full-duplex links, or when
Register 16.8 = 1.
5.6.7.2
Internal Digital Loopback (Test Loopback)
A test loopback function is provided for diagnostic testing of the LXT972A PHY. During
test loopback, twisted-pair interfaces are disabled. Data transmitted by the MAC is
internally looped back by the LXT972A PHY and returned to the MAC.
Test loopback is available for both 100BASE-TX and 10BASE-T operation, and is enabled
by setting the following register bits:
register bit 0.14 = 1 (Setting to enable loopback mode)
register bit 0.8 = 1 (Setting for full-duplex mode)
register bit 0.12 = 0 (Disable auto-negotiation)
Note:
Parallel detection can resolve the PHY configuration.
Figure 10
Loopback Paths
B3393-02
10T
Loopback
Digital
Block
MII
100X
Loopback
Analog
Block
LXT97x PHY
Operational
Loopback
Test Loopback
TX
Driver
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