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参数资料
| 型号： | WLA49VVA |
| 厂商： | National Semiconductor Corporation |
| 元件分类： | ADC |
| 英文描述： | Audio Sub-System with Dual-Mode Stereo Headphone and Mono High Efficiency Loudspeaker Amplifiers and Multi-Purpose ADC |
| 中文描述： | 音频子系统的双模单声道立体声耳机和扬声器放大器的高效率和多功能模数转换器 |
| 文件页数： | 28/112页 |
| 文件大小： | 5017K |
| 代理商： | WLA49VVA |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页当前第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页
12.0 Status & Control Registers (Continued)
12.2 CLOCKS CONFIGURATION REGISTER
This register is used to control the clocks throughout the chip.
TABLE 3. CLOCKS (0x01h)
Bits
Field
Description
0
DAC_CLK
Selects the clock to be used by the audio DAC system.
DAC_CLK
DAC Input Source
0
PLL Input (MCLK or I2S_CLK)
1
PLL Output
1
ADC_CLK
Selects the clock to be used by the audio ADC system.
ADC_CLK
Audio ADC Input Source
0
MCLK
1
PLL Output
7:2
R_DIV
Programs the R divider (divides from an expected 12.000 MHz input).
R_DIV
Divide Value
0
Bypass
1
Bypass
2
1.5
32
4
2.5
53
6
3.5
74
8
4.5
95
10
5.5
11
6
12
6.5
13 to 61
7 to 31
62
31.5
63
32
LM4935
www.national.com
22
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