参数资料
型号: XC68C812A4PVE5
厂商: Freescale Semiconductor
文件页数: 115/242页
文件大小: 0K
描述: MCU 16BIT LOW VOLT 112-LQFP
标准包装: 60
系列: HC12
核心处理器: CPU12
芯体尺寸: 16-位
速度: 5MHz
连通性: SCI,SPI
外围设备: POR,WDT
输入/输出数: 83
程序存储器容量: 4KB(4K x 8)
程序存储器类型: EEPROM
RAM 容量: 1K x 8
电压 - 电源 (Vcc/Vdd): 3 V ~ 3.6 V
数据转换器: A/D 8x8b
振荡器型: 内部
工作温度: 0°C ~ 70°C
封装/外壳: 112-LQFP
包装: 托盘
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Registers and Reset Initialization
MC68HC812A4 Data Sheet, Rev. 7
Freescale Semiconductor
201
16.6.4 ADT Control Register 3
FRZ1 and FRZ0 — Freeze Bits
The FRZ bits suspend ATD operation for background debugging. When debugging an application, it
is useful in many cases to have the ATD pause when a breakpoint is encountered. These two bits
determine how the ATD responds when background debug mode becomes active. See Table 16-1.
16.6.5 ATD Control Register 4
SMP1 and SMP0 — Sample Time Select Bits
These bits select one of four sample times after the buffered sample and transfer has occurred. Total
conversion time depends on initial sample time (two ATD clocks), transfer time (four ATD clocks), final
sample time (programmable, refer to Table 16-2), and resolution time (10 ATD clocks).
Address: $0063
Bit 7
654321
Bit 0
Read:
000000
FRZ1
FRZ0
Write:
Reset:
00000000
= Unimplemented
Figure 16-6. ATD Control Register 3 (ATDCTL3)
Table 16-1. ATD Response to Background Debug Enable
FRZ1:FRZ0
ATD Response
00
Continue conversions in active background mode
01
Reserved
10
Finish current conversion, then freeze
11
Freeze when BDM is active
Address: $0064
Bit 7
654321
Bit 0
Read:
0
SMP1
SMP0
PRS4
PRS3
PRS2
PRS1
PRS0
Write:
Reset:
00000001
= Unimplemented
Figure 16-7. ATD Control Register 4 (ATDCTL4)
Table 16-2. Final Sample Time Selection
SMP[1:0]
Final Sample Time
Total 8-Bit Conversion Time
00
2 ATD clock periods
18 ATD clock periods
01
4 ATD clock periods
20 ATD clock periods
10
8 ATD clock periods
24 ATD clock periods
11
16 ATD clock periods
32 ATD clock periods
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