参数资料
| 型号： | XIO2200AGGW |
| 厂商： | Texas Instruments |
| 文件页数： | 150/202页 |
| 文件大小： | 0K |
| 描述： | IC PCI-EXPRESS/BUS BRIDGE 176BGA |
| 产品培训模块： | PCI Express Basics |
| 标准包装： | 126 |
| 应用： | PCI Express 至 PCI 转换桥 |
| 接口： | PCI |
| 电源电压： | 1.35 V ~ 1.65 V，3 V ~ 3.6 V |
| 封装/外壳： | 176-LFBGA |
| 供应商设备封装： | 176-BGA MICROSTAR（15x15） |
| 包装： | 托盘 |
| 安装类型： | 表面贴装 |
| 产品目录页面： | 882 (CN2011-ZH PDF) |
| 配用： | XIO2200AEVM-ND - XIO2200AEVM |
| 其它名称： | 296-19617 |
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Classic PCI Configuration Space
38
March 5 2007 June 2011
SCPS154C
4
Classic PCI Configuration Space
The programming model of the XIO2200A PCI-Express to PCI bridge is compliant to the classic PCI-to-PCI
bridge programming model. The PCI configuration map uses the type 1 PCI bridge header.
All bits marked with a k are sticky bits and are reset by a global reset (GRST) or the internally-generated
power-on reset. All bits marked with a are reset by a PCI Express reset (PERST), a GRST, or the
internally-generated power-on reset. The remaining register bits are reset by a PCI Express hot reset, PERST,
GRST, or the internally-generated power-on reset.
Table 41. Classic PCI Configuration Register Map
REGISTER NAME
OFFSET
Device ID
Vendor ID
000h
Status
Command
004h
Class code
Revision ID
008h
BIST
Header type
Latency timer
Cache line size
00Ch
Device control base address
010h
Reserved
014h
Secondary latency timer
Subordinate bus number
Secondary bus number
Primary bus number
018h
Secondary status
I/O limit
I/O base
01Ch
Memory limit
Memory base
020h
Prefetchable memory limit
Prefetchable memory base
024h
Prefetchable base upper 32 bits
028h
Prefetchable limit upper 32 bits
02Ch
I/O limit upper 16 bits
I/O base upper 16 bits
030h
Reserved
Capabilities pointer
034h
Reserved
038h
Bridge control
Interrupt pin
Interrupt line
03Ch
Reserved
040h04Ch
Power management capabilities
Next item pointer
PM capability ID
050h
PM data
PMCSR_BSE
Power management CSR
054h
Reserved
058h05Ch
MSI message control
Next item pointer
MSI CAP ID
060h
MSI message address
064h
MSI upper message address
068h
Reserved
MSI message data
06Ch
Reserved
070h07Ch
Reserved
Next item pointer
SSID/SSVID capability ID
080h
Subsystem ID
Subsystem vendor ID
084h
Reserved
088h08Ch
PCI Express capabilities register
Next item pointer
PCI Express capability ID
090h
Device capabilities
094h
Device status
Device control
098h
Link capabilities
09Ch
Link status
Link control
0A0h
Reserved
0A4h0ACh
Serial-bus control and
status
Serial-bus slave address
Serial-bus word address
Serial-bus data
0B0h
One or more bits in this register are reset by a PCI Express reset (PERST), a GRST, or the internally-generated power-on reset.
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