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参数资料
| 型号： | A0800AMS3C |
| 厂商： | ADVANCED MICRO DEVICES INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 800 MHz, MICROPROCESSOR, CPGA462 |
| 封装： | STAGGERED, CERAMIC, PGA-453 |
| 文件页数： | 48/90页 |
| 文件大小： | 1492K |
| 代理商： | A0800AMS3C |
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Signal and Power-Up Requirements
Chapter 8
AMD Athlon Processor Model 4 Data Sheet
23792H—March 2001
Preliminary Information
FID[3:0] code. The SIP is sent to the processor using the SIP
protocol. This protocol uses the PROCRDY, CONNECT, and
CLKFWDRST signals, which are synchronous to SYSCLK.
Serial Initialization
Packet (SIP) Protocol
Refer to AMD Athlon System Bus Specification, order# 21902
for details of the SIP protocol.
8.2
Processor Warm Reset Requirements
The AMD Athlon
Processor Model 4
and Northbridge
Reset Pins
RESET cannot be asserted to the processor without also being
asserted to the Northbridge. RESET# to the Northbridge is the
same in as PCI RESET#. The minimum assertion for PCI
RESET# is 1 millisecond. AMD Southbridges enforce a
minimum assertion of RESET# to the processor, Northbridge,
or PCI of 1.5 to 2.0 milliseconds.
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