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参数资料
| 型号： | A82596SX |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | HIGH-PERFORMANCE 32-BIT LOCAL AREA NETWORK COPROCESSOR |
| 中文描述： | 1 CHANNEL(S), 20M bps, LOCAL AREA NETWORK CONTROLLER, CPGA132 |
| 封装： | CERAMIC, PGA-132 |
| 文件页数： | 64/77页 |
| 文件大小： | 787K |
| 代理商： | A82596SX |
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82596DX/SX
A.C. CHARACTERISTICS
(Continued)
82596SX C-STEP INPUT/OUTPUT SYSTEM TIMINGS
T
C
e
0
§
C to
a
85
§
C, V
CC
e
5V
g
10%
These timings assume the C
L
on all outputs is 50 pF unless otherwise specified. C
L
can be 20 pF to 120 pF,
however, timings must be derated.
All timing requirements are given in nanoseconds.
Symbol
Parameter
16 MHz
Notes
Min
Max
Operating Frequency
12.5 MHz
16 MHz
CLK2/2
T1
CLK2 Period
31
40
T2
CLK2 High
9
2.0V
T3
CLK2 Low
9
2.0V
T4
CLK2 Rise Time
D
8
0.8V to 3.7V
T5
CLK2 Fall Time
D
8
3.7V to 0.8V
T13
CA and BREQ Setup Time
11
1, 2, 3
T14
CA and BREQ Hold Time
8
1, 2, 3
T26
CA and BREQ, PORT Pulse Width
4 T1
3
T25
INT Valid Delay
1
40
T6
BHE, BLE, BON, and A1–A31 Valid Delay
3
36
T6b
LOCK
Y
Valid Delay
1
33
T7
BHE, BLE, LOCK, BON, and A1–A31 Float Delay
4
40
T8
W/R and ADS Valid Delay
1
33
T9
W/R and ADS Float Delay
4
35
T10
D0–D15 Write Data Valid Delay
3
40
T11
D0–D15 Write Data Float Delay
4
35
T27
D0–D15 CPU PORT Access Setup Time
9
2
T28
D0–D15 CPU PORT Access Hold Time
6
2
T29
PORT Setup Time
11
2
T30
PORT Hold Time
8
2
T17
RDY Setup Time
19
2
T18
RDY Hold Time
6
2
T19
D0–D15 READ Setup Time
9
2
T20
D0–D15 READ Hold Time
6
2
T12
HOLD Valid Delay
2
33
64
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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