参数资料
| 型号： | AD9548BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 110/112页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN/SYNCHRONIZR 88LFCSP |
| 产品变化通告： | AD9548 Mask Change 20/Oct/2010 |
| 标准包装： | 1 |
| 类型： | 时钟/频率发生器，同步器 |
| PLL： | 是 |
| 主要目的： | 以太网，SONET/SDH，Stratum |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 750kHz |
| 电源电压： | 1.71 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 88-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 88-LFCSP-VQ（12x12） |
| 包装： | 托盘 |
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Data Sheet
AD9548
Rev. E | Page 97 of 112
Table 128. Incremental Phase Offset Control
Address
Bits
Bit Name
Description
0x0A0C
[7:3]
Unused
[2]
Reset phase offset
Resets the incremental phase offset to 0.
This is an autoclearing bit.
[1]
Decr phase offset
Decrements the incremental phase offset by the amount specified in the
incremental phase lock offset step size register (Register 0x0314 to Register 0x0315).
This is an autoclearing bit.
[0]
Incr phase offset
Increments the incremental phase offset by the amount specified in the
incremental phase lock offset step size register (Register 0x0314 to Register 0x0315).
This is an autoclearing bit.
Table 129. Reference Profile Selection State Machine Startup1
Address
Bits
Bit Name
Description
0x0A0D
[7]
Detect DD
Setting this bit starts the profile selection state machine for Input Reference DD.
[6]
Detect D
Setting this bit starts the profile selection state machine for Input Reference D.
[5]
Detect CC
Setting this bit starts the profile selection state machine for Input Reference CC.
[4]
Detect C
Setting this bit starts the profile selection state machine for Input Reference C.
[3]
Detect BB
Setting this bit starts the profile selection state machine for Input Reference BB.
[2]
Detect B
Setting this bit starts the profile selection state machine for Input Reference B.
[1]
Detect AA
Setting this bit starts the profile selection state machine for Input Reference AA.
[0]
Detect A
Setting this bit starts the profile selection state machine for Input Reference A.
1
All bits in this register are autoclearing.
Table 130. Reference Validation Override Controls1
Address
Bits
Bit Name
Description
0x0A0E
[7]
Force Timeout DD
Setting this bit emulates a timeout of the validation timer for Reference DD.
This is an autoclearing bit.
[6]
Force Timeout D
Setting this bit emulates a timeout of the validation timer for Reference D.
This is an autoclearing bit.
[5]
Force Timeout CC
Setting this bit emulates a timeout of the validation timer for Reference CC.
This is an autoclearing bit.
[4]
Force Timeout C
Setting this bit emulates a timeout of the validation timer for Reference C.
This is an autoclearing bit.
[3]
Force Timeout BB
Setting this bit emulates a timeout of the validation timer for Reference BB.
This is an autoclearing bit.
[2]
Force Timeout B
Setting this bit emulates a timeout of the validation timer for Reference B.
This is an autoclearing bit.
[1]
Force Timeout AA
Setting this bit emulates a timeout of the validation timer for Reference AA.
This is an autoclearing bit.
[0]
Force Timeout A
Setting this bit emulates a timeout of the validation timer for Reference A.
This is an autoclearing bit.
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