参数资料
| 型号： | AD9548BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 4/112页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN/SYNCHRONIZR 88LFCSP |
| 产品变化通告： | AD9548 Mask Change 20/Oct/2010 |
| 标准包装： | 1 |
| 类型： | 时钟/频率发生器，同步器 |
| PLL： | 是 |
| 主要目的： | 以太网，SONET/SDH，Stratum |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 750kHz |
| 电源电压： | 1.71 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 88-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 88-LFCSP-VQ（12x12） |
| 包装： | 托盘 |
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Data Sheet
AD9548
Rev. E | Page 101 of 112
0x0D0B
[7]
Frequency clamped
The upper or lower frequency tuning word clamp is in effect.
[6]
History available
There is sufficient tuning word history available for holdover operation.
[5:3]
Active reference
priority
Priority value of the currently active reference.
000 = highest priority.
111 = lowest priority.
[2:0]
Active reference
Index of the currently active reference.
000 = Reference A.
001 = Reference AA.
010 = Reference B.
011 = Reference BB.
100 = Reference C.
101 = Reference CC.
110 = Reference D.
111 = Reference DD.
Table 140. Input Reference Status
Address
Bits
Bit Name
Description
0x0D0C
[7]
Profile selected
The control logic sets this bit when it assigns Ref A to one of the eight profiles.
[6:4]
Selected profile
The index (0 to 7) of the profile assigned to Ref A.
Note that these bits are meaningless unless Bit 7 = 1.
[3]
Valid
Ref A is valid for use (it is unfaulted and its validation timer has expired).
[2]
Fault
Ref A is not valid for use.
[1]
Fast
If Bit 7 = 1, then this bit indicates that the frequency of Ref A is higher than allowed
by its profile settings.
If Bit 7 = 0, then this bit indicates that the frequency of Ref A is above the maximum
input reference frequency supported by the device.
[0]
Slow
If Bit 7 = 1, then this bit indicates that the frequency of Ref A is lower than allowed by
its profile settings.
If Bit 7 = 0, then this bit indicates that the frequency of Ref A is below the minimum
input reference frequency supported by the device.
0x0D0D
[7:0]
Same as 0D0C but for REF AA instead of REF A.
0x0D0E
[7:0]
Same as 0D0C but for REF B instead of REF A.
0x 0D0F
[7:0]
Same as 0D0C but for REF BB instead of REF A.
0x0D10
[7:0]
Same as 0D0C but for REF C instead of REF A.
0x0D11
[7:0]
Same as 0D0C but for REF CC instead of REF A.
0x0D12
[7:0]
Same as 0D0C but for REF D instead of REF A.
0x0D13
[7:0]
Same as 0D0C but for REF DD instead of REF A.
Table 141. Holdover History1
Address
Bits
Bit Name
Description
0x0D14
[7:0]
Holdover history
Tuning word readback, Bits[7:0]
0x0D15
[7:0]
Tuning word readback, Bits[15:8]
0x0D16
[7:0]
Tuning word readback, Bits[23:9]
0x0D17
[7:0]
Tuning word readback, Bits[31:24]
0x0D18
[7:0]
Tuning word readback, Bits[39:32]
0x0D19
[7:0]
Tuning word readback, Bits[47:40]
1
These registers contain the current 48-bit DDS frequency tuning word generated by the tuning word history logic.
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