参数资料
| 型号： | AD9558BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 16/104页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK TRANSLATOR 64LFCSP |
| 产品变化通告： | AD9558 Minor Metal Mask Change 17/Apr/2012 |
| 标准包装： | 1 |
| 类型： | 时钟/频率转换器 |
| PLL： | 是 |
| 主要目的： | 以太网，SONET/SDH，Stratum |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，HSTL，LVDS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 4:6 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 1.25GHz |
| 电源电压： | 1.71 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 托盘 |
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Data Sheet
AD9558
Rev. B | Page 19 of 104
Pin No.
Mnemonic
Input/
Output
Pin Type
Description
43
REFA
I
Differential
input
Reference A Input. This internally biased input is typically ac-coupled and, when
configured as such, can accept any differential signal with single-ended swing up
to 3.3 V. If dc-coupled, input can be LVPECL, LVDS, or single-ended CMOS.
44
AA
REFA
EE
I
Differential
input
Complementary Reference A Input. This pin is the complementary input to Pin 43.
45, 46,
51, 52
DVDD3
I
Power
3.3 V Digital (Reference Input) Power Supply.
47
REFC
I
Differential
input
Reference C Input. This internally biased input is typically ac-coupled and, when
configured as such, can accept any differential signal with single-ended swing up
to 3.3 V. If dc-coupled, input can be LVPECL, LVDS, or single-ended CMOS.
48
AA
REFC
EE
I
Differential
input
Complementary Reference C Input. This pin is the complementary input to Pin 47.
49
REFD
I
Differential
input
Reference D Input. This internally biased input is typically ac-coupled and, when
configured as such, can accept any differential signal with single-ended swing up
to 3.3 V. If dc-coupled, input can be LVPECL, LVDS, or single-ended CMOS.
50
AA
REFD
EE
I
Differential
input
Complementary Reference D Input. This pin is the complementary input to Pin 49.
53
REFB
I
Differential
input
Reference B Input. This internally biased input is typically ac-coupled and, when
configured as such, can accept any differential signal with single-ended swing up
to 3.3 V. If dc-coupled, input can be LVPECL, LVDS, or single-ended CMOS.
54
AA
REFB
EE
I
Differential
input
Complementary Reference B Input. This pin is the complementary input to Pin 53.
57, 58,
59, 60,
61, 62,
63
M0, M1, M2,
M3, M4, M5,
M6
I/O
3.3 V CMOS
Configurable I/O Pins. These pins are configured under program control. The M7 pin
(Pin 41) is the last pin of this group.
64
DVDD3
I
Power
3.3 V Digital Supply.
EP
VSS
O
Exposed pad
The exposed pad must be connected to ground (VSS).
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PDF描述 |
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参数描述 |
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| AD9559BCPZ-REEL7 | 功能描述:时钟发生器及支持产品 Multi-protocol line card dual clock RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
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