参数资料
| 型号： | AD9558BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 78/104页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK TRANSLATOR 64LFCSP |
| 产品变化通告： | AD9558 Minor Metal Mask Change 17/Apr/2012 |
| 标准包装： | 1 |
| 类型： | 时钟/频率转换器 |
| PLL： | 是 |
| 主要目的： | 以太网，SONET/SDH，Stratum |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，HSTL，LVDS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 4:6 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 1.25GHz |
| 电源电压： | 1.71 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 托盘 |
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Data Sheet
AD9558
Rev. B | Page 75 of 104
IRQ MASK (REGISTER 0x020A TO REGISTER 0x020F)
The IRQ mask register bits form a one-to-one correspondence with the bits of the IRQ monitor register (0x0D02 to 0x0D09). When set to
Logic 1, the IRQ mask bits enable the corresponding IRQ monitor bits to indicate an IRQ event. The default for all IRQ mask bits is Logic 0,
which prevents the IRQ monitor from detecting any internal interrupts.
Table 48. IRQ Mask for SYSCLK
Address
Bits
Bit Name
Description
0x020A
[7:6]
Reserved
5
SYSCLK unlocked
Enables IRQ for indicating a SYSCLK PLL state transition from locked to unlocked
4
SYSCLK locked
Enables IRQ for indicating a SYSCLK PLL state transition from unlocked to locked
3
APLL unlocked
Enables IRQ for indicating an APLL state transition from locked to unlocked
2
APLL locked
Enables IRQ for indicating an APLL state transition from unlocked to locked
1
APLL cal complete
Enables IRQ for indicating that APLL (LCVCO) calibration has completed
0
APLL cal started
Enables IRQ for indicating that APLL (LCVCO) calibration has begun
Table 49. IRQ Mask for Distribution Sync, Watchdog Timer, and EEPROM
Address
Bits
Bit Name
Description
0x020B
[7:5]
Reserved
4
Pin program end
Enables IRQ for indicating successful completion of a pin program ROM load
3
Sync distribution
Enables IRQ for indicating a distribution sync event
2
Watchdog timer
Enables IRQ for indicating expiration of the watchdog timer
1
EEPROM fault
Enables IRQ for indicating a fault during an EEPROM load or save operation
0
EEPROM complete
Enables IRQ for indicating successful completion of an EEPROM load or save operation
Table 50. IRQ Mask for the Digital PLL
Address
Bits
Bit Name
Description
0x020C
7
Switching
Enables IRQ for indicating that the DPLL is switching to a new reference
6
Closed
Enables IRQ for indicating that the DPLL has entered closed-loop operation
5
Freerun
Enables IRQ for indicating that the DPLL has entered free run mode
4
Holdover
Enables IRQ for indicating that the DPLL has entered holdover mode
3
Frequency unlocked
Enables IRQ for indicating that the DPLL lost frequency lock
2
Frequency locked
Enables IRQ for indicating that the DPLL has acquired frequency lock
1
Phase unlocked
Enables IRQ for indicating that the DPLL lost phase lock
0
Phase locked
Enables IRQ for indicating that the DPLL has acquired phase lock
Table 51. IRQ Mask for History Update, Frequency Limit and Phase Slew Limit
Address
Bits
Bit Name
Description
0x020D
[7:5]
Reserved
4
History updated
Enables IRQ for indicating the occurrence of a tuning word history update
3
Frequency unclamped
Enables IRQ for indicating a frequency limit state transition from clamped to unclamped
2
Frequency clamped
Enables IRQ for indicating a state transition of the frequency limiter from unclamped to clamped
1
Phase slew unlimited
Enables IRQ for indicating a state transition of the phase slew limiter from slew limiting to not
slew limiting
0
Phase slew limited
Enables IRQ for indicating a state transition of the phase slew limiter from not slew limiting to
slew limiting
相关PDF资料 |
PDF描述 |
|---|---|
| AD9557BCPZ | IC CLOCK TRANSLATOR 40LFCSP |
| V375C36M150BG | CONVERTER MOD DC/DC 36V 150W |
| AD9547BCPZ | IC CLOCK GEN/SYNCHRONIZR 64LFCSP |
| D38999/20MF11JN | CONN RCPT 11POS WALL MNT W/SCKT |
| AD9549ABCPZ | IC CLOCK GEN/SYNCHRONIZR 64LFCSP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| AD9558BCPZ-REEL7 | 功能描述:IC CLK XLATR PLL 1250MHZ 64LFCSP RoHS:是 类别:集成电路 (IC) >> 时钟/计时 - 专用 系列:- 标准包装:28 系列:- 类型:时钟/频率发生器 PLL:是 主要目的:Intel CPU 服务器 输入:时钟 输出:LVCMOS 电路数:1 比率 - 输入:输出:3:22 差分 - 输入:输出:无/是 频率 - 最大:400MHz 电源电压:3.135 V ~ 3.465 V 工作温度:0°C ~ 85°C 安装类型:表面贴装 封装/外壳:64-TFSOP （0.240"，6.10mm 宽） 供应商设备封装:64-TSSOP 包装:管件 |
| AD9559 | 制造商:AD 制造商全称:Analog Devices 功能描述:Dual PLL, Quad Input, Multiservice Line Card Adaptive Clock Translator |
| AD9559/PCBZ | 功能描述:时钟和定时器开发工具 Multi-protocol line card dual clock RoHS:否 制造商:Texas Instruments 产品:Evaluation Modules 类型:Clock Conditioners 工具用于评估:LMK04100B 频率:122.8 MHz 工作电源电压:3.3 V |
| AD9559BCPZ | 功能描述:时钟发生器及支持产品 Multi-protocol line card dual clock RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
| AD9559BCPZ-REEL7 | 功能描述:时钟发生器及支持产品 Multi-protocol line card dual clock RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
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