参数资料
| 型号： | AD9558BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 68/104页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK TRANSLATOR 64LFCSP |
| 产品变化通告： | AD9558 Minor Metal Mask Change 17/Apr/2012 |
| 标准包装： | 1 |
| 类型： | 时钟/频率转换器 |
| PLL： | 是 |
| 主要目的： | 以太网，SONET/SDH，Stratum |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，HSTL，LVDS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 4:6 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 1.25GHz |
| 电源电压： | 1.71 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 托盘 |
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AD9558
Data Sheet
Rev. B | Page 66 of 104
Reg
Addr
(Hex)
Opt
Name
D7
D6
D5
D4
D3
D2
D1
D0
Def
Profile B (for REFB)
0x0740
L
Reference
period (up to
1.1 ms)
Nominal period (fs), Bits[7:0] (default: 125 s = 1/(8 kHz) for default system clock setting)
00
0x0741
L
Nominal period (fs), Bits[15:8]
A2
0x0742
L
Nominal period (fs), Bits[23:16]
94
0x0743
L
Nominal period (fs), Bits[31:24]
1A
0x0744
L
Nominal period (fs), Bits[39:32]
1D
0x0745
L
Frequency
tolerance
Inner tolerance (1 ppm), Bits[7:0] (for reference invalid to valid; 50% down to 1 ppm) (default: 5%)
14
0x0746
L
Inner tolerance (1 ppm), Bits[15:8] (for reference invalid to valid; 50% down to 1 ppm)
00
0x0747
L
Reserved
Inner tolerance, Bits[19:16]
00
0x0748
L
Outer tolerance (1 ppm), Bits[7:0] (for reference valid to invalid; 50% down to 1 ppm] (default: 10%)
0A
0x0749
L
Outer tolerance (1 ppm), Bits[15:8] (for reference valid to invalid; 50% down to 1 ppm)
00
0x074A
L
Reserved
Outer tolerance, Bits[19:16]
00
0x074B
L
Validation
Validation timer (ms), Bits[7:0] (up to 65.5 seconds)
0A
0x074C
L
Validation timer (ms), Bits[15:8] (up to 65.5 seconds)
00
0x074D
L
Reserved
00
0x074E
L
Select base
loop filter
Reserved
Sel high PM
base loop
filter
00
0x074F
L
DPLL loop BW
Digital PLL loop BW scaling factor[7:0] (default: 0x01F4 = 50 Hz)
F4
0x0750
L
Digital PLL loop BW scaling factor[15:8]
01
0x0751
L
Reserved
BW scaling
factor[16]
00
0x0752
L
DPLL
R divider
(20 bits)
R divider[7:0]
00
0x0753
L
R divider[15:8]
00
0x0754
L
Reserved
Enable REFB
divide-by-2
R divider[19:16]
00
0x0755
DPLL
N divider
(17 bits)
Digital PLL feedback divider—Integer Part N1[7:0]
1F
0x0756
Digital PLL feedback divider—Integer Part N1[15:8]
5B
0x0757
Reserved
Digital PLL
feedback
divider—
Integer Part
N1[16]
00
0x0758
DPLL
fractional
feedback
divider
(24 bits)
Digital PLL fractional feedback divider—FRAC1[7:0]
00
0x0759
Digital PLL fractional feedback divider—FRAC1[15:8]
00
0x075A
Digital PLL fractional feedback divider—FRAC1[23:16]
00
0x075B
DPLL
fractional
feedback
divider
modulus
(24 bits)
Digital PLL feedback divider modulus—MOD1[7:0]
01
0x075C
Digital PLL feedback divider modulus—MOD1[15:8]
00
0x075D
Digital PLL feedback divider modulus—MOD1[23:16]
00
0x075E
L
Lock detectors
Phase lock threshold (ps), Bits[7:0]
BC
0x075F
L
Phase lock threshold(ps), Bits[15:8]
02
0x0760
L
Phase lock fill rate[7:0]
0A
0x0761
L
Phase lock drain rate[7:0]
0A
0x0762
L
Frequency lock threshold[7:0]
BC
0x0763
L
Frequency lock threshold[15:8]
02
0x0764
L
Frequency lock threshold[23:16]
00
0x0765
L
Frequency lock fill rate[7:0]
0A
0x0766
L
Frequency lock drain rate[7:0]
0A
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| AD9559BCPZ-REEL7 | 功能描述:时钟发生器及支持产品 Multi-protocol line card dual clock RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
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