参数资料
| 型号： | ADP3198JCPZ-RL |
| 厂商： | ON Semiconductor |
| 文件页数： | 3/31页 |
| 文件大小： | 0K |
| 描述： | IC BUCK CTRLR 8BIT PROG 40LFCSP |
| 产品变化通告： | MFG CHG Notification ADI to ON Semi |
| 标准包装： | 2,500 |
| 应用： | 控制器，Intel VRM |
| 输入电压： | 12V |
| 输出数： | 4 |
| 输出电压： | 0.5 V ~ 1.6 V |
| 工作温度： | 0°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 40-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 40-LFCSP-VQ（6x6） |
| 包装： | 带卷 (TR) |
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ADP3198
SPECIFICATIONS
VCC = 5 V, FBRTN = GND, T A = 0°C to 85°C, unless otherwise noted. 1
Table 1.
Parameter
Symbol
Conditions
Min
Typ
Max
Unit
REFERENCE CURRENT
Reference Bias Voltage
V IREF
1.5
V
Reference Bias Current
I IREF
R IREF = 100 kΩ
14.25
15
15.75
μA
ERROR AMPLIFIER
Output Voltage Range 2
V COMP
0
4.4
V
Accuracy
V FB
Relative to nominal DAC output, referenced to
?11
+11
mV
FBRTN, LLSET = CSREF (see Figure 2)
Load Line Positioning Accuracy
Differential Nonlinearity
V FB(BOOT)
In startup
CSREF ? LLSET = 80 mV
1.089
?78
?1
1.1
?80
1.111
?82
+1
V
mV
LSB
Input Bias Current
FBRTN Current
Output Current
Gain Bandwidth Product
I FB
I FBRTN
I COMP
GBW (ERR)
I FB = I IREF
FB forced to V OUT – 3%
COMP = FB
13.5
15
65
500
20
16.5
200
μA
μA
μA
MHz
Slew Rate
COMP = FB
25
V/μs
LLSET Input Voltage Range
V LLSET
Relative to CSREF
?350
+350
mV
LLSET Input Bias Current
BOOT Voltage Hold Time
I LLSET
t BOOT
C DELAY = 10 nF
?10
2
+10
nA
ms
VID INPUTS
Input Low Voltage
Input High Voltage
V IL(VID)
V IH(VID)
VID(X), VIDSEL
VID(X), VIDSEL
0.8
0.4
V
V
Input Current
VID Transition Delay Time 2
No CPU Detection Turn-Off Delay Time 2
I IN(VID)
VID code change to FB change
VID code change to PWM going low
400
5
?1
μA
ns
μs
OSCILLATOR
Frequency Range 2
f OSC
0.25
4
MHz
Frequency Variation
f PHASE
T A = 25°C, R T = 243 kΩ, 4-phase
156
200
240
kHz
T A = 25°C, R T = 113 kΩ, 4-phase
T A = 25°C, R T = 51 kΩ, 4-phase
400
800
kHz
kHz
Output Voltage
RAMPADJ Output Voltage
RAMPADJ Input Current Range
V RT
V RAMPADJ
I RAMPADJ
R T = 243 kΩ to GND
RAMPADJ ? FB
1.9
?50
1
2.0
2.1
+50
50
V
mV
μA
CURRENT SENSE AMPLIFIER
Offset Voltage
V OS(CSA)
CSSUM ? CSREF (see Figure 3)
?2
+2
mV
Input Bias Current
Gain Bandwidth Product
Slew Rate
I BIAS(CSSUM)
GBW (CSA)
CSSUM = CSCOMP
C CSCOMP = 10 pF
?10
10
10
+10
nA
MHz
V/μs
Input Common-Mode Range
CSSUM and CSREF
0
3.5
V
Output Voltage Range
Output Current
I CSCOMP
0.05
500
3.5
V
μA
Current Limit Latch-Off Delay Time
t OC(DELAY)
C DELAY = 10 nF
8
ms
IMON Output
IMON
10 × (CSREF ? CSCOMP) > 50 mV
?6
+6
%
CURRENT BALANCE AMPLIFIER
Common-Mode Range
V SW(X)CM
?600
+200
mV
Input Resistance
Input Current
Input Current Matching
R SW(X)
I SW(X)
ΔI SW(X)
SW(X) = 0 V
SW(X) = 0 V
SW(X) = 0 V
10
8
?5
17
12
26
20
+5
kΩ
μA
%
CURRENT LIMIT COMPARATOR
ILIMIT Bias Current
I ILIMIT
I ILIMIT = 2/3 × I IREF
9
10
11
μA
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PDF描述 |
|---|---|
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参数描述 |
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