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参数资料
型号： ADSP-BF535PBBZ-200
厂商： Analog Devices Inc
文件页数： 24/44页
文件大小： 0K
描述： IC DSP CONTROLLER 16BIT 260-BGA
产品培训模块： Blackfin® Processor Core Architecture Overview
Blackfin® Device Drivers
Blackfin® Optimizations for Performance and Power Consumption
Blackfin® System Services
标准包装： 1
系列： Blackfin®
类型： 定点
接口： PCI，SPI，SSP，UART，USB
时钟速率： 200MHz
非易失内存： 外部
芯片上RAM： 308kB
电压 - 输入/输出： 3.30V
电压 - 核心： 1.50V
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 260-BBGA
供应商设备封装： 260-PBGA（19x19）
包装： 托盘
ADSP-BF535
–30–
REV. A
Serial Ports
Table 17 through Table 22 and Figure 14 describe Serial Port
timing.
Table 17. Serial Ports—External Clock
Parameter
Min
Max
Unit
Timing Requirements
tSFSE
TFS/RFS Setup Before TCLK/RCLK
1
3.0
ns
tHFSE
TFS/RFS Hold After TCLK/RCLK
1
3.0
ns
tSDRE
Receive Data Setup Before RCLK
1
3.0
ns
tHDRE
Receive Data Hold Before RCLK
1
3.0
ns
tSCLKWE
TCLK/RCLK Width
(0.5
tSCLKE) – 1
ns
tSCLKE
TCLK/RCLK Period
2
tSCLK
ns
1 Referenced to sample edge.
Table 18. Serial Ports—Internal Clock
Parameter
Min
Max
Unit
Timing Requirements
tSFSI
TFS/RFS Setup Before TCLK/RCLK
1
7.0
ns
tHFSI
TFS/RFS Hold After TCLK/RCLK
1
2.0
ns
tSDRI
Receive Data Setup Before RCLK
1
7.0
ns
tHDRI
Receive Data Hold Before RCLK
1
4.0
ns
1 Referenced to sample edge.
Table 19. Serial Ports—External or Internal Clock
Parameter
Min
Max
Unit
Switching Characteristics
tDFSE
RFS Delay After RCLK (Internally Generated RFS)
1
10.0
ns
tHOFSE
RFS Hold After RCLK (Internally Generated RFS)
1
3.0
ns
1 Referenced to drive edge.
Table 20. Serial Ports—External Clock
Parameter
Min
Max
Unit
Switching Characteristics
tDFSE
TFS Delay After TCLK (Internally Generated TFS)
1
10.0
ns
tHOFSE
TFS Hold After TCLK (Internally Generated TFS)
1
3.0
ns
tDDTE
Transmit Data Delay After TCLK
1
10.0
ns
tHDTE
Transmit Data Hold After TCLK
1
3.0
ns
1 Referenced to drive edge.
Table 21. Serial Ports—Internal Clock
Parameter
Min
Max
Unit
Switching Characteristics
tDFSI
TFS Delay After TCLK (Internally Generated TFS)
1
6.0
ns
tHOFSI
TFS Hold After TCLK (Internally Generated TFS)
1
0.0
ns
tDDTI
Transmit Data Delay After TCLK
1
8.0
ns
tHDTI
Transmit Data Hold After TCLK
1
0.0
ns
tSCLKWI
TCLK/RCLK Width
0.5
tSCLK
ns
1 Referenced to drive edge.
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