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参数资料
| 型号： | EP20K100BC196-2 |
| 厂商： | ALTERA CORP |
| 元件分类： | PLD |
| 英文描述： | LOADABLE PLD, PBGA196 |
| 文件页数： | 25/68页 |
| 文件大小： | 975K |
| 代理商： | EP20K100BC196-2 |
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31
4317K–AVR–03/2013
AT90PWM2/3/2B/3B
7.1.5
ADC Clock – clk
ADC
The ADC is provided with a dedicated clock domain. This allows halting the CPU and I/O clocks
in order to reduce noise generated by digital circuitry. This gives more accurate ADC conversion
results.
7.2
Clock Sources
The device has the following clock source options, selectable by Flash Fuse bits as illustrated
Table 7-1. The clock from the selected source is input to the AVR clock generator, and routed to
the appropriate modules.
Note:
1. For all fuses “1” means unprogrammed while “0” means programmed.
The various choices for each clocking option is given in the following sections. When the CPU
wakes up from Power-down or Power-save, the selected clock source is used to time the start-
Table 7-1.
Device Clocking Options Select(1) AT90PWM2/3
Device Clocking Option
CKSEL3..0
External Crystal/Ceramic Resonator
1111 - 1000
Reserved
0111- 0100
PLL output divided by 4 : 16 MHz
0011
Calibrated Internal RC Oscillator
0010
Reserved
0001
External Clock
0000
Table 7-2.
Device Clocking Options Select AT90PWM2B/3B
Device Clocking Option
System
Clock
PLL Input
CKSEL3..0
(1)
1.For all fuses “1” means unprogrammed while “0” means programmed
External Crystal/Ceramic Resonator
Ext Osc (2)
2.Ext Osc : External Osc
RC Osc (3)
3.RC Osc : Internal RC Oscillator
1111 - 1000
PLL output divided by 4 : 16 MHz / External
Crystal/Ceramic Resonator/ PLL driven by External Crystal
/Ceramic Resonator
Ext Osc
0100
PLL output divided by 4 : 16 MHz / PLL driven by External
Crystal/Ceramic Resonator
PLL / 4
Ext Osc
0101
Reserved
N/A
0111- 0110
PLL output divided by 4 : 16 MHz
PLL / 4
RC Osc
0011
Calibrated Internal RC Oscillator
RC Osc
0010
PLL output divided by 4 : 16 MHz / PLL driven by External
clock
PLL / 4
Ext Clk (4)
4.Ext Clk : External Clock Input
0001
External Clock
Ext Clk
RC Osc
0000
相关PDF资料 |
PDF描述 |
|---|---|
| EP20K100BC196-3 | LOADABLE PLD, PBGA196 |
| EP20K100BI196-1 | LOADABLE PLD, PBGA196 |
| EP20K100BI196-2 | LOADABLE PLD, PBGA196 |
| EP20K100BI196-3 | LOADABLE PLD, PBGA196 |
| EP20K100BC324-1 | LOADABLE PLD, PBGA324 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| EP20K100BC356-1 | 功能描述:FPGA - 现场可编程门阵列 CPLD - APEX 20K 416 Macro 252 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP20K100BC356-1ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
| EP20K100BC356-1V | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| EP20K100BC356-2 | 功能描述:FPGA - 现场可编程门阵列 CPLD - APEX 20K 416 Macro 252 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP20K100BC356-2ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
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