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参数资料
| 型号： | GT-48004A |
| 厂商： | Galileo Technology Services, LLC |
| 英文描述： | Four Port Switched Fast Ethernet Controller(四端口、交换式快速以太网控制器) |
| 中文描述： | 四端口交换式快速以太网控制器（四端口，交换式快速以太网控制器） |
| 文件页数： | 88/106页 |
| 文件大小： | 953K |
| 代理商： | GT-48004A |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页当前第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页
GT-48004A Four Port Switched Fast Ethernet Controller
N:\Marketing\Docs\Archive\48004A\DATASHEET\Rev 1.0\484ads10.fm
Revision 1.0
82
Status, Offset: 0x14002c (Read-Only)
CPU and Sniffer Numbers, Offset: 0x140030
Bi ts
Fi e l d Na m e
Fun cti o n
In iti a l Va l u e
4:0
DevNum
Device Number.
Indicates the GT-48004A number chosen by the
designer.
DAddr[4:0] at RESET
5
DRAMSize
DRAM Size.
Indicates the DRAM size.
0- 2Mbyte
1- 1Mbyte
DAddr[5] at RESET
6
Port0Par
Port0 Partition.
This bit indicates the port 0 Partition status.
0 - No Partition (Normal mode)
1 - Partition
0x0
7
Port0LTF
Port0 Link Test Fail.
This bit indicates the port 0 Link Test status.
0 - Link Test Pass
1 - Link Test Fail
0x0
8
Port1Par
Port1 Partition.
This bit indicates the port 1 Partition status.
0 - No Partition (Normal mode)
1 - Partition
0x0
9
Port1LTF
Port1 Link Test Fail.
This bit indicates the port 1 Link Test status.
0 - Link Test Pass
1 - Link Test Fail
0x0
Bi ts
Fi e l d Na m e
Fun cti o n
In iti a l Va l u e
4:0
SnifDevNum
Sniffer Device Number.
These bits specify the Sniffer Device Number chosen
by the designer. The same value should be pro-
grammed to all GT-48004A/GT-48001A devices shar-
ing the same PCI bus.
0x0 (bit 4 is MSB)
7:5
SnifPortNum
Sniffer Port Number.
These bits specify the Sniffer Port Number chosen by
the designer. The same value should be programmed
to all GT-48004A/GT-48001A devices sharing the
same PCI bus.
0x0 (bit 7 is MSB)
12:8
CPUDevNum
CPU Device Number.
These bits specify the Device Number of the CPU as
chosen by the designer. This number must not be the
same as any other GalNet device is the system. The
same value should be programmed to all GT-48004A/
GT-48001A devices sharing the same PCI bus. The
corresponding bit for the CPUDevNum value should
be set in the Device table (offset 0x40) for all GT-
48004A/GT-48001A devices sharing the same PCI
bus.
0x0 (bit 12 is MSB)
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