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参数资料
| 型号： | HW-V4SX35-VIDEO-SK-EC |
| 厂商： | Xilinx Inc |
| 文件页数： | 37/112页 |
| 文件大小： | 0K |
| 描述： | VIRTEX-4 VIDEO STARTER KIT |
| 产品变化通告： | Development Systems Discontinuation 12/Jan/2009 |
| 标准包装： | 1 |
| 系列： | Virtex®-4 |
| 类型： | DSP FPGA |
| 适用于相关产品： | Virtex?-4 SX |
| 所含物品： | 开发平台，子板，电源，闪存卡，CMOS 图像传感器和软件 |
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R
Adding a Processor to a System Generator Design
Figure 3-3: EDK Processor GUI
Exporting the Design as a Pcore
The Xilinx Platform Studio (XPS) is a tool that is shipped with the EDK. XPS is an
integrated development environment that allows a processor to be created, configured
with IP, and for software to be written and compiled into the processor ’s bitstream. When
configuring a processor in XPS, a user is presented with a list of available IP that can be
connected to a processor. Each IP that can be added on as a peripheral to a processor must
be packaged as a pcore. System Generator provides a compilation target that compiles a
user design into a pcore.
To export a user design as a pcore, the EDK processor block must be used in conjunction
with the Export as a pcore to EDK compilation target found in the System Generator block.
The EDK processor must to be configured for EDK export mode. This is done by setting
After configuring the EDK processor, an EDK pcore can be generated by using the System
Generator compilation GUI. Refer to Figure 3-4 . Double click on the System Generator
block and set Compilation to Export as a pcore to EDK . Press the Settings … button to bring up
the EDK Export Settings dialog box. This controls where the pcore is exported to and
assigns a version number to the pcore.
Refer to System Generator Compilation Types chapter in the System Generator User Guide for
more detailed information on the EDK export compilation target.
Video Starter Kit
UG217 (v1.5) October 26, 2006
37
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PDF描述 |
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参数描述 |
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