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参数资料
| 型号： | HW-V4SX35-VIDEO-SK-EC |
| 厂商： | Xilinx Inc |
| 文件页数： | 95/112页 |
| 文件大小： | 0K |
| 描述： | VIRTEX-4 VIDEO STARTER KIT |
| 产品变化通告： | Development Systems Discontinuation 12/Jan/2009 |
| 标准包装： | 1 |
| 系列： | Virtex®-4 |
| 类型： | DSP FPGA |
| 适用于相关产品： | Virtex?-4 SX |
| 所含物品： | 开发平台，子板，电源，闪存卡，CMOS 图像传感器和软件 |
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R
Testing the Video Function in System Generator
Figure 6-7: Design Saved as vid_go.mdl
Testing the Video Function in System Generator
Run the vid_go.mdl design at the top level to verify the expected results. If a gold model
is available, it can be compared to the System Generator results at the top level.
Generating the Pcore
To generate the pcore, generate an HDL netlist for the pcore using the pcore-export output
flow.
1.
2.
3.
4.
Before generating the pcore, create a new EDK project named edk_vid_go by
copying the VSK diagnostics EDK project named edk_vid_go_start to a new
directory.
Copy the %VSK\Examples\SysgenTutorial\VSK_pcore_tutorial
edk_vid_go_start directory to a new directory. Rename the directory to
edk_vid_go . An EDK project containing the finished tutorial is also available as
edk_vid_go_solution .
Open the completed model vid_go.mdl and open the vid_gain_offset
subsystem.
Open the EDK processor block and make sure EDK Pcore Generation is selected.
Close the EDK Processor block.
Open the System Generator block. Select Export as a pcore to EDK as a compilation
target. Select Virtex-4 V4SX35-10ff668 as a Part and select a 10 ns clock period.
Video Starter Kit
UG217 (v1.5) October 26, 2006
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PDF描述 |
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参数描述 |
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