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参数资料
| 型号： | HYB18T1G160C2F-3.7 |
| 厂商： | QIMONDA AG |
| 元件分类： | DRAM |
| 英文描述： | 64M X 16 DDR DRAM, 0.5 ns, PBGA84 |
| 封装： | GREEN, PLASTIC, TFBGA-84 |
| 文件页数： | 25/70页 |
| 文件大小： | 3996K |
| 代理商： | HYB18T1G160C2F-3.7 |
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HY[B/I]18T1G[40/80/16]0C2[C/F](L)
1-Gbit Double-Data-Rate-Two SDRAM
Internet Data Sheet
Rev. 1.60, 2008-08
31
09262007-3YK7-BKKG
FIGURE 4
Single-ended AC Input Test Conditions Diagram
TABLE 26
Differential DC and AC Input and Output Logic Levels
FIGURE 5
Differential DC and AC Input and Output Logic Levels Diagram
Symbol
Parameter
Min.
Max.
Unit
Notes
V
IN(dc)
DC input signal voltage
–0.3
V
DDQ + 0.3
—
1)
V
IN(dc) specifies the allowable DC execution of each input of differential pair such as CK, CK, DQS, DQS etc.
V
ID(dc)
DC differential input voltage
0.25
V
DDQ + 0.6
—
2)
V
ID(dc) specifies the input differential voltage VTR– VCP required for switching. The minimum value is equal to VIH(dc) – VIL(dc).
V
ID(ac)
AC differential input voltage
0.5
V
DDQ + 0.6
V
3)
V
ID(ac) specifies the input differential voltage VTR – VCP required for switching. The minimum value is equal to VIH(ac) – VIL(ac).
V
IX(ac)
AC differential cross point input voltage
0.5
× V
DDQ – 0.175
0.5
× V
DDQ + 0.175
V
4)
4) The value of
V
IX(ac) is expected to equal 0.5 × VDDQ of the transmitting device and VIX(ac) is expected to track variations in VDDQ. VIX(ac)
indicates the voltage at which differential input signals must cross.
V
OX(ac)
AC differential cross point output voltage 0.5
× V
DDQ – 0.125
0.5
× V
DDQ + 0.125
V
5)
5) The value of
V
OX(ac) is expected to equal 0.5 × VDDQ of the transmitting device and VOX(ac) is expected to track variations in VDDQ. VOX(ac)
indicates the voltage at which differential input signals must cross.
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PDF描述 |
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参数描述 |
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