参数资料
| 型号： | IP-PCIE/8 |
| 厂商： | Altera |
| 文件页数： | 155/256页 |
| 文件大小： | 0K |
| 描述： | IP PCI EXPRESS, X8 |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | PCI Express 编译器，8 倍链路宽度 |
| 许可证： | 初始许可证 |
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Testbench & Example Designs
Simple DMA
Example Design
This example design shows how to create an endpoint application layer
design that interfaces to the PCI Express MegaCore function. The design
includes the following:
■
■
Memory that can be a target for PCI Express memory read and write
transactions.
A DMA channel that can initiate memory read and write transactions
on the PCI Express link.
The example endpoint design is completely contained within a supported
Altera device and relies on no other hardware interface than the PCI
Express link. This allows you to use the example design for the initial
hardware validation of your system.
The Quartus II software generates the example design in the same
language that you used for the variation (generated by the variation name
file); the example design is either Verilog HDL or VHDL.
When the MegaWizard interface generates the MegaCore variant, the
example endpoint design is created with the MegaCore function
variation. The example design includes two main components, the
MegaCore function variation and an application layer example design as
The example endpoint design application layer provides these features:
■
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■
Shows you how to interface to the PCI Express MegaCore function
Target memory that can be written to and read from PCI Express
memory write and read transactions
DMA channel that can be used to initiate memory read and write
transactions on the PCI Express link
Master memory block that can be used to source and sink data for
DMA initiated memory transactions
Data pattern generator that can be used to source data for DMA
initiated memory write transactions
Support for two virtual channels (VCs)
The example endpoint design can be used in the testbench simulation and
to compile a complete design for an Altera device. All of the modules
necessary to implement the example design with the variation file are
contained in separate files, based on the language you use:
< variation name > _example_top.vhd
< variation name > _example_top.v
altpcierd_dprambe.v or altpcierd_dprambe.vhd
Altera Corporation
December 2006
PCI Express Compiler Version 6.1
5–5
PCI Express Compiler User Guide
相关PDF资料 |
PDF描述 |
|---|---|
| IP-POSPHY4 | IP POS-PHY L4 |
| IP-RIOPHY | IP RAPID I/O |
| IP-RLDRAMII | IP RLDRAM II CONTROLLER |
| IP-RSDEC | IP REED-SOLOMON DECODER |
| IP-SDI | IP VIDEO INTERFACE - SDI |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPPOEINJ1295 | 制造商:Speco Technologies 功能描述:PoE Injector - 12.95W |
| IPPOEINJ25 | 制造商:Speco 功能描述:POE INJECTOR - 25W UP TO 325FT |
| IPPOERPT | 制造商:Speco 功能描述:POE-LAN REPEATER POWER AND DATA UP TO 1000FT |
| IPPOESPL1295 | 制造商:Speco 功能描述:POE SPLITTER - 12.95WUP TO 325FT |
| IPPOESPL25 | 制造商:Speco 功能描述:POE SPLITTER - 25W UP TO 325FT |
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