参数资料
| 型号： | IP-PCIE/8 |
| 厂商： | Altera |
| 文件页数： | 233/256页 |
| 文件大小： | 0K |
| 描述： | IP PCI EXPRESS, X8 |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | PCI Express 编译器，8 倍链路宽度 |
| 许可证： | 初始许可证 |
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Table C–1. test_out Signals for the x1 and x4 MegaCore Functions (Part 2 of 17)
Signal
rx_reqid_tlp
Subblock
TRN rxtl
Bit
37:14
Description
Receive ReqID . This 24-bit signal reports the requester ID
of the completion transaction layer packet when
rx_hval_tlp and rx_ok_tlp are asserted.
The 8 MSBs of this signal also report the type and format of the
transaction when rx_fval_tlp and rx_ok_tlp are valid.
rx_ok_tlp
TRN rxtl
38
Receive sequencing valid. This is a sequencing signal pulse. All
previously-described signals ( test_out[37:0] ) are valid
only when this signal is asserted.
tx_req_tlp
TRN txtl
39
Transmit request to data link layer. This signal is a global virtual
channel request for transmitting transaction layer packet to the
data link layer.
tx_ack_tlp
TRN txtl
40
Transmit request acknowledge from data link layer. This signal
serves as the acknowledge signal for the global request from
the transaction layer when accepting a transaction layer packet
from the data link layer.
tx_dreq_tlp
TRN txtl
41
Transmit data requested from data link layer. This is a
sequencing signal that makes a request for next data from the
transaction layer.
tx_err_tlp
TRN txtl
42
Transmit nullify transaction layer packet request. This signal is
asserted by the transaction layer in order to nullify a transmitted
transaction layer packet.
gnt_vc
TRN txtl
50:43
Transmit virtual channel arbitration result. This signal reports
arbitration results of the transaction layer packet that is currently
being transmitted.
tx_ok_tlp
TRN txtl
51
Transmit sequencing valid. This signal, which depends on the
number of initialized lanes on the link, is a sequencing signal
pulse that enables data transfer from the transaction layer to the
data link layer.
lpm_sm
CFG pmgt 55:52
Power management state machine. This signal indicates the
power management state machine encoding responsible for
scheduling the transition to legacy low power:
0000b: l0_rst
●
0001b: l0
●
0010b: l1_in0
●
0011b: l1_in1
●
0100b: l0_in
●
0101b: l0_in_wt
●
0110b: l2l3_in0
●
0111b: l2l3_in1
●
1000b: l2l3_rdy
●
others: reserved
●
Altera Corporation
December 2006
PCI Express Compiler Version 6.1
C–3
PCI Express Compiler User Guide
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| IPPOESPL1295 | 制造商:Speco 功能描述:POE SPLITTER - 12.95WUP TO 325FT |
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