参数资料
| 型号： | IP-PCIE/8 |
| 厂商： | Altera |
| 文件页数： | 251/256页 |
| 文件大小： | 0K |
| 描述： | IP PCI EXPRESS, X8 |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | PCI Express 编译器，8 倍链路宽度 |
| 许可证： | 初始许可证 |
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Table C–2. test_out Signals for the x8 MegaCore Functions (Part 3 of 4)
Signal
rx_8d00
Subblock
MAC
ltssm
Bit
55:48
Description
Received 8 D0.0 symbol: This signal indicates that eight
consecutive Idle data symbols have been received. This
signal is meaningful for config.idle and recovery.idle
states.
rx_idl
MAC
ltssm
63:56
Received 8 D0.0 symbol: This signal indicates that eight
consecutive Idle data symbols have been received. This
signal is meaningful for config.idle and recovery.idle
states.
rx_linkpad
MAC
ltssm
71:64
Received Link Pad TS: This signal indicates that the Link
field of the received TS1/
TS2 is set to PAD for the specified lane.
rx_lanepad
MAC
ltssm
79:72
Received Lane Pad TS: This signal indicates that the Lane
field of the received TS1/
TS2 is set to PAD for the specified lane.
rx_tsnum
MAC
ltssm
87:80
Received Consecutive Identical TSNumber: This signal
reports the number of consecutive identical TS1/TS2
which have been received with exactly the same
parameters since entering this state. When the maximum
number is reached, this signal restarts from zero. Note
that this signal corresponds to the lane configured as
logical lane 0.
lane_act
lane_rev
MAC
ltssm
MAC
91:88
95:92
Lane Active Mode: This signal indicates the number of
Lanes that have been configured during training:
0001:
1
lane
0010:
2
lanes
0100:
4
lanes
1000:
8
lanes
Reserved
ltssm
count0
count1
count2
count3
count4
count5
MAC
deskew
MAC
deskew
MAC
deskew
MAC
deskew
MAC
deskew
MAC
deskew
98:96
101:99
104:102
107:105
110:108
113:111
Deskew fifo count lane 0: This signal indicates the number
of Words in the deskew fifo for physical lane 0.
Deskew fifo count lane 1: This signal indicates the number
of Words in the deskew fifo for physical lane 1 .
Deskew fifo count lane 2: This signal indicates the number
of Words in the deskew fifo for physical lane 2.
Deskew fifo count lane 3: This signal indicates the number
of Words in the deskew fifo for physical lane 3.
Deskew fifo count lane 4: This signal indicates the number
of Words in the deskew fifo for physical lane 4.
Deskew fifo count lane 5:This signal indicates the number
of Words in the deskew fifo for physical lane 5.
Altera Corporation
December 2006
PCI Express Compiler Version 6.1
C–21
PCI Express Compiler User Guide
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