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参数资料
| 型号： | ISL6329CRZ |
| 厂商： | Intersil |
| 文件页数： | 26/38页 |
| 文件大小： | 0K |
| 描述： | IC CTRLR PWM SYNC BUCK DL 60QFN |
| 标准包装： | 43 |
| 应用： | 控制器，AMD SVI |
| 输入电压： | 5 V ~ 12 V |
| 输出数： | 2 |
| 输出电压： | 0.0125 V ~ 1.55 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | * |
| 封装/外壳： | * |
| 供应商设备封装： | * |
| 包装： | * |
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ISL6329
I 2 C Read and Write Protocol
WRITE TO A SINGLE REGISTER
S
1000_1100
A
0000_0000
A
RGS1_DATA
A
P
WRITE TO ALL REGISTERS
S
1000_1100
A
0000_0000
A
RGS0_DATA
A
RGS1_DATA
A
RGS2_DATA
A
P
READ FROM SINGLE REGISTER
S
1000_1100
A REG_ADDR A
P
S
1000_1101
A
RGS0_DATA
N
P
READ FROM ALL REGISTERS
S
1000_1100
A
0000_0000
A
P
S
1000_1101
A
RGS0_DATA
A
RGS1_DATA
A
RGS2_DATA
N
P
DRIVEN BY MASTER
DRIVEN BY ISL6329
S = START CONDITION
P = STOP CONDITION
A = ACKNOWLEDGE
N = NO ACKNOWLEDGE
Register Bit Definitions
The bits for RGS0 and RGS1 are utilized in the same manner by
the ISL6329 (see Table 5). Bit-7 enables the overvoltage
protection trip point to be increased. Bit-6 enables the Power-
good trip point to be increased. These bits will be interpreted by
the ISL6329 according to Table 7. Bits 5 through 0 determine the
TABLE 8. BITS [5:0] REGISTER RGS0 and RGS1 (VOLTAGE
MARGINING OFFSET) (Continued)
BIT5 BIT4 BIT3 BIT2 BIT1 BIT0
VO5 VO4 VO3 VO2 VO1 VO0
1 0 0 1 1 1
V OFFSET
(mV)
-625
amount of offset for the particular regulator. See Table 8 for the
bit codes and the corresponding offset voltages from the
nominal DAC.
TABLE 7. BIT [7] AND [6] of REGISTER RGS0 AND RGS1
BIT 7 OVP TRIP LEVEL
0 1.8V or V DAC + 250mV, whichever is greater
1 1.8V or V DAC + 500mV, whichever is greater
BIT 6 PGOOD TRIP LEVEL
0 VDAC CORE +250mV/-300mV
VDAC NB - 300mV
1
1
1
1
1
1
1
1
1
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
1
0
0
0
0
0
1
1
1
1
0
0
0
1
1
0
0
1
1
0
0
1
0
1
0
1
0
1
0
-600
-575
-550
-525
-500
-475
-450
-425
-400
1
VDAC CORE +300mV/-350mV
VDAC NB - 350mV
1
1
1
1
0
0
0
0
0
1
1
0
-375
-350
NOTE: All Pgood trip points have 50mV hysteresis
TABLE 8. BITS [5:0] REGISTER RGS0 and RGS1 (VOLTAGE
MARGINING OFFSET)
1
1
1
1
1
1
0
0
0
0
1
1
1
0
0
1
0
1
-325
-300
-275
BIT5
VO5
1
1
1
1
1
1
1
BIT4
VO4
0
0
0
0
0
0
0
BIT3
VO3
0
0
0
0
0
0
0
BIT2
VO2
0
0
0
0
1
1
1
BIT1
VO1
0
0
1
1
0
0
1
BIT0
VO0
0
1
0
1
0
1
0
V OFFSET
(mV)
-800
-775
-750
-725
-700
-675
-650
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
0
0
1
1
1
1
1
1
1
1
1
0
0
0
0
1
1
1
1
1
0
0
1
1
0
0
1
0
1
0
1
0
1
0
1
0
-250
-225
-200
-175
-150
-125
-100
-75
-50
26
FN7800.0
April 19, 2011
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PDF描述 |
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参数描述 |
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