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参数资料
| 型号： | LMK04010BISQ/NOPB |
| 厂商： | National Semiconductor |
| 文件页数： | 38/65页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK CONDITIONER W/PLL 48LLP |
| 标准包装： | 1,000 |
| 系列： | PowerWise® |
| 类型： | 时钟调节器 |
| PLL： | 是 |
| 输入： | LVCMOS |
| 输出： | 2VPECL，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:5 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 1.296GHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 3.15 V ~ 3.45 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-WFQFN 裸露焊盘 |
| 供应商设备封装： | 48-LLP（7x7） |
| 包装： | 带卷 (TR) |
| 其它名称： | LMK04010BISQ |
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C
Po
u
t1
LEuWire
CLKuWire
DATAuWire
GOE
LD
(optional)
To Host
C
L
Ko
u
t0
C
L
Ko
u
t0
*
C
L
Ko
u
t1
*
C
L
Ko
u
t1
C
L
Ko
u
t2
B
C
L
Ko
u
t2
A
C
L
Ko
u
t3
*
C
L
Ko
u
t3
C
L
Ko
u
t4
*
C
L
Ko
u
t4
To
System
SYNC*
C
L
Ki
n
0
C
L
Ki
n
0
*
Bias
Vcc
LDObyp1
LDObyp2
10 PF
0.1 PF
1 PF
0.1 PF
LMK040xx
100
VCXO
OSCin
OSCin*
100
0.1 uF
CLKin1*
CLKin1
0.1 PF
To
System
To Host
CPout2
100 pF
To
System
Fout
Reference Clock #1
(Primary)
Reference Clock #2
(Secondary)
PLL1 Loop Filter
PLL2 Loop Filter
Rterm
0.1 PF
120
120
To
System
To
System
51
0.1 PF
120
120
To
System
0.47 PF
D
L
D
_
BYP
3
p
F
3
p
F
3
p
F
0.1 PF
SNOSAZ8J – SEPTEMBER 2008 – REVISED SEPTEMBER 2011
APPLICATION INFORMATION
System Level Diagram
The following diagram illustrates the typical interconnection of the LMK040xx in a clocking application.
Figure 13. Typical Application
Figure 13 shows an LMK04000 family device with external circuitry. The primary reference clock input is at
CLKin0/0*. A secondary reference clock is driving CLKin1/1*. Both clocks are depicted as AC coupled differential
drivers. The VCXO attached to the OSCin/OSCin* port is configured as an AC coupled single-ended driver. Any
of the input ports (CLKin0/0*, CLKin1/1*, or OSCin/OSCin*) may be configured as either differential or single-
ended. These options are discussed later in the data sheet.
The diagram shows an optional connection between the LD pin and GOE. With this arrangement, the LD pin can
be programmed to output a lock detect signal that is active HIGH (see Table 29 for optional LD pin outputs). If
lock is lost, the LD pin will transition to a LOW, pulling GOE low and causing all clock outputs to be disabled.
This scheme should be used only if disabling the clock outputs is desirable when lock is lost.
Copyright 2008–2011, Texas Instruments Incorporated
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PDF描述 |
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参数描述 |
|---|---|
| LMK04010BISQX | 制造商:NSC 制造商全称:National Semiconductor 功能描述:Low-Noise Clock Jitter Cleaner with Cascaded PLLs |
| LMK04010BISQX/NOPB | 功能描述:时钟合成器/抖动清除器 RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
| LMK04011BISQ | 制造商:Texas Instruments 功能描述:Clock Conditioner 48-Pin LLP EP T/R |
| LMK04011BISQ/NOPB | 功能描述:时钟合成器/抖动清除器 RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
| LMK04011BISQE | 制造商:Texas Instruments 功能描述:Clock Conditioner 48-Pin LLP EP T/R 制造商:Texas Instruments 功能描述:PRECISION CLOCK CONDITIONER, 48LLP |
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