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参数资料
| 型号： | M68TC11E20B56 |
| 厂商： | 飞思卡尔半导体(中国)有限公司 |
| 英文描述： | HC11 Microcontrollers |
| 中文描述： | HC11微控制器 |
| 文件页数： | 142/242页 |
| 文件大小： | 1525K |
| 代理商： | M68TC11E20B56 |
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Timing Systems
M68HC11E Family Data Sheet, Rev. 5.1
142
Freescale Semiconductor
9.5.2 Timer Interrupt Flag Register 2
Bits of this register indicate the occurrence of timer system events. Coupled with the four high-order bits
of TMSK2, the bits of TFLG2 allow the timer subsystem to operate in either a polled or interrupt driven
system. Each bit of TFLG2 corresponds to a bit in TMSK2 in the same position.
Clear flags by writing a 1 to the corresponding bit position(s).
TOF — Timer Overflow Interrupt Flag
Set when TCNT changes from $FFFF to $0000
RTIF — Real-Time Interrupt Flag
The RTIF status bit is automatically set to 1 at the end of every RTI period. To clear RTIF, write a byte
to TFLG2 with bit 6 set.
PAOVF — Pulse Accumulator Overflow Interrupt Flag
Refer to
9.7 Pulse Accumulator
.
PAIF — Pulse Accumulator Input Edge Interrupt Flag
Refer to
9.7 Pulse Accumulator
.
Bits [3:0] — Unimplemented
Always read 0
9.5.3 Pulse Accumulator Control Register
Bits RTR[1:0] of this register select the rate for the RTI system. The remaining bits control the pulse
accumulator and IC4/OC5 functions.
DDRA7 — Data Direction for Port A Bit 7
Refer to
Chapter 6 Parallel Input/Output (I/O) Ports
.
PAEN — Pulse Accumulator System Enable Bit
Refer to
9.7 Pulse Accumulator
.
PAMOD — Pulse Accumulator Mode Bit
Refer to
9.7 Pulse Accumulator
.
Address:
$1025
Bit 7
6
5
4
3
2
1
Bit 0
Read:
TOF
RTIF
PAOVF
PAIF
Write:
Reset:
0
0
0
0
0
0
0
0
= Unimplemented
Figure 9-22. Timer Interrupt Flag 2 Register (TFLG2)
Address:
$1026
Bit 7
6
5
4
3
2
1
Bit 0
Read:
DDRA7
PAEN
PAMOD
PEDGE
DDRA3
I4/O5
RTR1
RTR0
Write:
Reset:
0
0
0
0
0
0
0
0
Figure 9-23. Pulse Accumulator Control Register (PACTL)
相关PDF资料 |
PDF描述 |
|---|---|
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参数描述 |
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