M68TC11E20B56 PDF资料下载(78/242 页)HC11 Microcontrollers

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您现在的位置：买卖IC网 > PDF目录359091 > M68TC11E20B56 (飞思卡尔半导体(中国)有限公司) HC11 Microcontrollers PDF资料下载

参数资料

型号：	M68TC11E20B56
厂商：	飞思卡尔半导体(中国)有限公司
英文描述：	HC11 Microcontrollers
中文描述：	HC11微控制器
文件页数：	78/242页
文件大小：	1525K
代理商：	M68TC11E20B56

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Central Processor Unit (CPU)

M68HC11E Family Data Sheet, Rev. 5.1

78

Freescale Semiconductor

TSTA

Test A for Zero

or Minus

Test B for Zero

or Minus

Transfer Stack

Pointer to X

Transfer Stack

Pointer to Y

Transfer X to

Stack Pointer

Transfer Y to

Stack Pointer

Wait for

Interrupt

Exchange D

with X

Exchange D

with Y

A – 0

A

INH

4D

—

2

—

—

—

—

0

0

TSTB

B – 0

B

INH

5D

—

2

—

—

—

—

0

0

TSX

SP + 1

IX

INH

30

—

3

—

—

—

—

—

—

—

—

TSY

SP + 1

IY

INH

18

30

—

4

—

—

—

—

—

—

—

—

TXS

IX – 1

SP

INH

35

—

3

—

—

—

—

—

—

—

—

TYS

IY – 1

SP

INH

18

35

—

4

—

—

—

—

—

—

—

—

WAI

Stack Regs & WAIT

INH

3E

—

**

—

—

—

—

—

—

—

—

XGDX

IX

D, D

IX

INH

8F

—

3

—

—

—

—

—

—

—

—

XGDY

IY

D, D

IY

INH

18

8F

—

4

—

—

—

—

—

—

—

—

Cycle

*

**

Infinity or until reset occurs

12 cycles are used beginning with the opcode fetch. A wait state is entered which remains in effect for an integer number of MPU E-clock

cycles (n) until an interrupt is recognized. Finally, two additional cycles are used to fetch the appropriate interrupt vector (14 + n total).

Operands

dd

ff

hh

ii

jj

kk

ll

mm

rr

= 8-bit direct address ($0000–$00FF) (high byte assumed to be $00)

= 8-bit positive offset $00 (0) to $FF (255) (is added to index)

= High-order byte of 16-bit extended address

= One byte of immediate data

= High-order byte of 16-bit immediate data

= Low-order byte of 16-bit immediate data

= Low-order byte of 16-bit extended address

= 8-bit mask (set bits to be affected)

= Signed relative offset $80 (–128) to $7F (+127)

(offset relative to address following machine code offset byte))

Operators

( )

+

Contents of register shown inside parentheses

Is transferred to

Is pulled from stack

Is pushed onto stack

Boolean AND

Arithmetic addition symbol except where used as inclusive-OR symbol

in Boolean formula

Exclusive-OR

Multiply

Concatenation

Arithmetic subtraction symbol or negation symbol (two’s complement)

⊕

:

–

Condition Codes

—

0

1

↓

Bit not changed

Bit always cleared

Bit always set

Bit cleared or set, depending on operation

Bit can be cleared, cannot become set

Table 4-2. Instruction Set (Sheet 7 of 7)

Mnemonic

Operation

Description

Addressing

Mode

Instruction

Operand

Condition Codes

H

I

Opcode

Cycles

S

X

N

Z

V

C

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