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参数资料
| 型号： | M68TC11E20B56 |
| 厂商： | 飞思卡尔半导体(中国)有限公司 |
| 英文描述： | HC11 Microcontrollers |
| 中文描述： | HC11微控制器 |
| 文件页数： | 172/242页 |
| 文件大小： | 1525K |
| 代理商： | M68TC11E20B56 |
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Electrical Characteristics
M68HC11E Family Data Sheet, Rev. 5.1
172
Freescale Semiconductor
10.18 MC68L11E9/E20 Serial Peirpheral Interface Characteristics
Num
Characteristic
(1)
1. V
DD
= 3.0 Vdc to 5.5 Vdc, V
SS
= 0 Vdc, T
A
= T
L
to T
H
, all timing is shown with respect to 20% V
DD
and 70% V
DD
, unless
otherwise noted
2. Time to data active from high-impedance state
3. Assumes 100 pF load on SCK, MOSI, and MISO pins
Symbol
E9
E20
Unit
Min
Max
Min
Max
Frequency of operation
E clock
f
o
dc
2.0
dc
2.0
MHz
E-clock period
t
CYC
500
—
500
—
ns
Operating frequency
Master
Slave
f
op(m)
f
op(s)
f
o
/32
dc
f
o
/2
f
o
f
o
/128
dc
f
o
/2
f
o
MHz
1
Cycle time
Master
Slave
t
CYC(m)
t
CYC(s)
2
1
32
—
2
1
128
—
t
CYC
2
Enable lead time
(2)
Slave
t
lead(s)
1
—
1
—
t
CYC
3
Enable lag time
(2)
Slave
t
lag(s)
1
—
1
—
t
CYC
4
Clock (SCK) high time
Master
Slave
t
w(SCKH)m
t
w(SCKH)s
t
CYC
–30
1/2
t
CYC
–30
16 t
CYC
—
t
CYC
–30
1/2
t
CYC
–30
64 t
CYC
—
ns
5
Clock (SCK) low time
Master
Slave
t
w(SCKL)m
t
w(SCKL)s
t
CYC
–30
1/2
t
CYC
–30
16 t
CYC
—
t
CYC
–30
1/2
t
CYC
–30
64 t
CYC
—
ns
6
Data setup time (inputs)
Master
Slave
t
su(m)
t
su(s)
40
40
—
—
40
40
—
—
ns
7
Data hold time (inputs)
Master
Slave
t
h(m)
t
h(s)
40
40
—
—
40
40
—
—
ns
8
Slave access time
CPHA = 0
CPHA = 1
t
a
0
0
50
50
0
0
50
50
ns
9
Disable time (hold time
to high-impedance state)
Slave
t
dis
—
60
—
60
ns
10
Data valid
(3)
(after enable edge)
t
v
—
60
—
60
ns
11
Data hold time (outputs)
(after enable edge)
t
ho
0
—
0
—
ns
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PDF描述 |
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参数描述 |
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