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参数资料
| 型号： | M68TC11E20B56 |
| 厂商： | 飞思卡尔半导体(中国)有限公司 |
| 英文描述： | HC11 Microcontrollers |
| 中文描述： | HC11微控制器 |
| 文件页数： | 83/242页 |
| 文件大小： | 1525K |
| 代理商： | M68TC11E20B56 |
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Effects of Reset
M68HC11E Family Data Sheet, Rev. 5.1
Freescale Semiconductor
83
5.2.6 Configuration Control Register
EE[3:0] — EEPROM Mapping Bits
EE[3:0] apply only to MC68HC811E2. Refer to
Chapter 2 Operating Modes and On-Chip Memory
.
NOSEC — Security Mode Disable Bit
Refer to
Chapter 2 Operating Modes and On-Chip Memory
.
NOCOP — COP System Disable Bit
0 = COP enabled (forces reset on timeout)
1 = COP disabled (does not force reset on timeout)
ROMON — ROM (EPROM) Enable Bit
Refer to
Chapter 2 Operating Modes and On-Chip Memory
.
EEON — EEPROM Enable Bit
Refer to
Chapter 2 Operating Modes and On-Chip Memory
.
5.3 Effects of Reset
When a reset condition is recognized, the internal registers and control bits are forced to an initial state.
Depending on the cause of the reset and the operating mode, the reset vector can be fetched from any
of six possible locations. Refer to
Table 5-2
.
These initial states then control on-chip peripheral systems to force them to known startup states, as
described in the following subsections.
5.3.1 Central Processor Unit (CPU)
After reset, the central processor unit (CPU) fetches the restart vector from the appropriate address during
the first three cycles and begins executing instructions. The stack pointer and other CPU registers are
indeterminate immediately after reset; however, the X and I interrupt mask bits in the condition code
register (CCR) are set to mask any interrupt requests. Also, the S bit in the CCR is set to inhibit stop mode.
Address:
$103F
Bit 7
6
5
4
3
2
1
Bit 0
Read:
EE3
EE2
EE1
EE0
NOSEC
NOCOP
ROMON
EEON
Write:
Reset:
0
0
0
0
1
1
1
1
Figure 5-3. Configuration Control Register (CONFIG)
Table 5-2. Reset Cause, Reset Vector, and Operating Mode
Cause of Reset
Normal Mode
Vector
Special Test
or Bootstrap
POR or RESET pin
$FFFE, FFFF
$BFFE, $BFFF
Clock monitor failure
$FFFC, FFFD
$BFFC, $BFFD
COP Watchdog Timeout
$FFFA, FFFB
$BFFA, $BFFB
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