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参数资料
| 型号： | M68TC11E20B56 |
| 厂商： | 飞思卡尔半导体(中国)有限公司 |
| 英文描述： | HC11 Microcontrollers |
| 中文描述： | HC11微控制器 |
| 文件页数： | 98/242页 |
| 文件大小： | 1525K |
| 代理商： | M68TC11E20B56 |
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Parallel Input/Output (I/O) Ports
M68HC11E Family Data Sheet, Rev. 5.1
98
Freescale Semiconductor
6.2 Port A
Port A shares functions with the timer system and has:
Three input-only pins
Three output-only pins
Two bidirectional I/O pins
DDRA7 — Data Direction for Port A Bit 7
Overridden if an output compare function is configured to control the PA7 pin
0 = Input
1 = Output
The pulse accumulator uses port A bit 7 as the PAI input, but the pin can also be used as
general-purpose I/O or as an output compare.
NOTE
Even when port A bit 7 is configured as an output, the pin still drives the
input to the pulse accumulator.
PAEN — Pulse Accumulator System Enable Bit
Refer to
Chapter 9 Timing Systems
.
PAMOD — Pulse Accumulator Mode Bit
Refer to
Chapter 9 Timing Systems
.
PEDGE — Pulse Accumulator Edge Control Bit
Refer to
Chapter 9 Timing Systems
.
DDRA3 — Data Direction for Port A Bit 3
This bit is overridden if an output compare function is configured to control the PA3 pin.
0 = Input
1 = Output
I4/O5 — Input Capture 4/Output Compare 5 Bit
Refer to
Chapter 9 Timing Systems
.
RTR[1:0] — RTI Interrupt Rate Select Bits
Refer to
Chapter 9 Timing Systems
.
Address:
$1000
Bit 7
6
5
4
3
2
1
Bit 0
Read:
Write:
Reset:
PA7
PA6
PA5
PA4
PA3
PA2
PA1
PA0
I
0
0
0
I
I
I
I
Alternate function:
PAI
OC1
OC2
OC1
OC3
OC1
OC4
OC1
IC4/OC5
OC1
IC1
—
IC2
—
IC3
—
And/or:
I = Indeterminate after reset
Figure 6-1. Port A Data Register (PORTA)
Address:
$1026
Bit 7
6
5
4
3
2
1
Bit 0
Read:
Write:
Reset:
DDRA7
PAEWN
PAMOD
PEDGE
DDRA3
I4/O5
RTR1
RTR0
0
0
0
0
0
0
0
0
Figure 6-2. Pulse Accumulator Control Register (PACTL)
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PDF描述 |
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参数描述 |
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