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参数资料
| 型号： | MAX17080GTL+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 10/48页 |
| 文件大小： | 0K |
| 描述： | IC CONTROLLER AMD SVI 40-TQFN |
| 标准包装： | 60 |
| 应用： | 控制器，AMD SVI |
| 输入电压： | 2.7 V ~ 5.5 V |
| 输出数： | 3 |
| 输出电压： | 0.013 V ~ 1.55 V |
| 工作温度： | -40°C ~ 105°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 40-WFQFN 裸露焊盘 |
| 供应商设备封装： | 40-TQFN-EP（5x5） |
| 包装： | 管件 |
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AMD 2-/3-Output Mobile Serial
VID Controller
ELECTRICAL CHARACTERISTICS (continued)
(Circuit of Figure 2, V IN = 12V, V CC = V DD = V IN3 = V SHDN = V PGD_IN = 5V, V DDIO = 1.8V, V OPTION = V GNDS_ = V AGND = V PGND ,
V FBDC_ = V FBAC_ = V OUT3 = V CSP_ = V CSN _ = 1.2V, all DAC codes set to the 1.2V code, T A = -40°C to +105°C , unless otherwise
noted. Typical values are at T A = +25 ° C.) (Note 5)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
Data Setup Time
SVC Low Period
t SU;DAT
t LOW
10
160
ns
ns
SVC High Period
SVC/SVD Rise and Fall Time
t HIGH
t R , t F
Measured from 10% to 90% of V DDIO
Input filters on SVD and SVC suppress
noise spike less than 50ns
60
40
ns
ns
INPUTS AND OUTPUTS
Logic Input Levels
SHDN , rising edge, hysteresis = 225mV
0.8
2.0
V
High
V CC -
0.4
Four-Level Input Logic Levels
OPTION, ILIM3
3.3V
2.75
3.85
V
2V
Low
1.65
2.35
0.4
PGD_IN Logic Input Threshold
PGD_IN, rising edge, hysteresis = 65mV
0.3 x
V DDIO
0.7 x
V DDIO
V
Note 3: When the inductor is in continuous conduction, the output voltage has a DC regulation level lower than the error-comparator
threshold by 50% of the ripple. In discontinuous conduction, the output voltage has a DC regulation level higher than the
error-comparator threshold by 50% of the ripple. The core SMPSs have an integrator that corrects for this error. The NB
SMPS has an offset determined by the ILIM3 pin, and a -6.5mV/A load line.
Note 4: Production testing limitations due to package handling require relaxed maximum on-resistance specifications for the TQFN
package.
Note 5: Specifications to T A = -40 ° C to +105 ° C are guaranteed by design, not production tested.
SVC
t HD;STA
t LOW
t R
t HIGH
t F
t HD;DAT
t SU;DAT
t SU;STO
t BUF
SVD
V IH
V IL
Figure 1. Timing Definitions Used in the Electrical Characteristics
10
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