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参数资料
| 型号： | MC68HC11F1VPU2 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | Technical Summary 8-Bit Microcontroller |
| 中文描述： | 8-BIT, EEPROM, 2 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 14 X 14 MM, 1.40 MM HEIGHT, PLASTIC, LQFP-80 |
| 文件页数： | 103/163页 |
| 文件大小： | 711K |
| 代理商： | MC68HC11F1VPU2 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页当前第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页
MOTOROLA
OPERATING MODES AND ON-CHIP MEMORY
MC68HC11F1
4-6
TECHNICAL DATA
4.3 System Initialization
Registers and bits that control initialization and the basic operation of the MCU are pro-
tected against writes except under special circumstances. The following table lists reg-
isters that can be written only once after reset or that must be written within the first 64
cycles after reset.
$1028
SPIE
SPE
DWOM
MSTR
CPOL
CPHA
SPR1
SPR0
SPCR
$1029
SPIF
WCOL
0
MODF
0
Bit 0
SPSR
$102A
Bit 7
654321
Bit 0
SPDR
$102B
TCLR
0
SCP1
SCP0
RCKB
SCR2
SCR1
SCR0
BAUD
$102C
R8
T8
0
M
WAKE
0
SCCR1
$102D
TIE
TCIE
RIE
ILIE
TE
RE
RWU
SBK
SCCR2
$102E
TDRE
TC
RDRF
IDLE
OR
NF
FE
0
SCSR
$102F
Bit 7
654321
Bit 0
SCDR
$1030
CCF
0
SCAN
MULT
CD
CC
CB
CA
ADCTL
$1031
Bit 7
654321
Bit 0
ADR1
$1032
Bit 7
654321
Bit 0
ADR2
$1033
Bit 7
654321
Bit 0
ADR3
$1034
Bit 7
654321
Bit 0
ADR4
$1035
0
PTCON
BPRT3
BPRT2
BPRT1
BPRT0
BPROT
$1036
Reserved
$1037
Reserved
$1038
GWOM
CWOM
CLK4X
00000
OPT2
$1039
ADPU
CSEL
IRQE
DLY
CME
FCME
CR1
CR0
OPTION
$103A
Bit 7
654321
Bit 0
COPRST
$103B
ODD
EVEN
0
BYTE
ROW
ERASE
EELAT
EEPGM
PPROG
$103C
RBOOT
SMOD
MDA
IRV
PSEL3
PSEL2
PSEL1
PSEL0
HPRIO
$103D
RAM3
RAM2
RAM1
RAM0
REG3
REG2
REG1
REG0
INIT
$103E
TILOP
0
OCCR
CBYP
DISR
FCM
FCOP
0
TEST1
$103F
EE3`
EE2
EE1
EE0
1
NOCOP
1
EEON
CONFIG
$1040
Reserved
to
$105B
Reserved
$105C
IO1SA
IO1SB
IO2SA
IO2SB
GSTHA
GSTHB
PSTHA
PSTHB
CSSTRH
$105D
IO1EN
IO1PL
IO2EN
IO2PL
GCSPR
PCSEN
PSIZA
PSIZB
CSCTL
$105E
GA15
GA14
GA13
GA12
GA11
GA10
0
CSGADR
$105F
IO1AV
IO2AV
0
GNPOL
GAVLD
GSIZA
GSIZB
GSIZC
CSGSIZ
Table 4-1 Register and Control Bit Assignments (Continued)
The register block can be remapped to any 4-Kbyte boundary.
Bit 7
654321
Bit 0
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PDF描述 |
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