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参数资料
| 型号： | MC68HC11F1VPU2 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | Technical Summary 8-Bit Microcontroller |
| 中文描述： | 8-BIT, EEPROM, 2 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 14 X 14 MM, 1.40 MM HEIGHT, PLASTIC, LQFP-80 |
| 文件页数： | 53/163页 |
| 文件大小： | 711K |
| 代理商： | MC68HC11F1VPU2 |
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MOTOROLA
ELECTRICAL CHARACTERISTICS
MC68HC11F1
A-12
TECHNICAL DATA
NOTES:
1. Input clocks with duty cycles other than 50% affect bus performance.
2. Indicates a parameter affected by clock stretching. Add n(tcyc) to parameter value, where:
n = 1, 2, or 3 depending on values written to CSSTRH register.
3. All timing is shown with respect to 20% VDD and 70% VDD, unless otherwise noted.
Table A-7 Expansion Bus Timing
VDD = 5.0 Vdc ± 5%, VSS = 0 Vdc, TA = TL to TH
Num
Characteristic
Symbol
2.0 MHz
3.0 MHz
4.0 MHz
Unit
Min
Max
Min
Max
Min
Max
Frequency of Operation (E-Clock Frequency)
fo
dc
2.0
dc
3.0
dc
4.0
MHz
1
Cycle Time
tcyc = 1/fo
tcyc
500
—
333
—
250
—
ns
2
Pulse Width, E Low
PWEL = 1/2 tcyc – 20 ns
PWEL
230
—
147
—
105
—
ns
3
Pulse Width, E High
PWEH = 1/2 tcyc – 25 ns
(Note 2)
PWEH
225
—
142
—
100
—
ns
4A
4B
E Clock
Rise Time
Fall Time
tr
tf
—
20
—
20
18
—
20
15
ns
9
Address Hold Time
tAH = 1/8 tcyc – 10 ns
tAH
53—32—21—
ns
11
Address Delay Time
tAD = 1/8 tcyc + 40 ns
tAD
—
103
—82—71
ns
12
Address Valid Time to E Rise
tAV = PWEL – tAD
tAV
128
—65—34—
ns
17
Read Data Setup Time
tDSR
30—30—20—
ns
18
Read Data Hold Time
tDHR
0—0—0—
ns
19
Write Data Delay Time
tDDW
—40—40—40
ns
21
Write Data Hold Time
tDHW = 1/8 tcyc
tDHW
63—42—31—
ns
29
MPU Address Access Time
tACCA = tcyc – tf – tDSR – tAD
(Note 2)
tACCA
348
—
203
—
144
—
ns
39
Write Data Setup Time
tDSW = PWEH – tDDW
(Note 2)
tDSW
185
—
102
—
60
—
ns
50
E Valid Chip Select Delay Time
tECSD
—40—40—40
ns
51
E Valid Chip Select Access Time
tECSA = PWEH – tECSD – tDSR
(Note 2)
tECSA
155
—72—40—
ns
52
Chip Select Hold Time
tCH
020020020
ns
54
Address Valid Chip Select Delay Time
tACSD = 1/4 tcyc + 40 ns
tACSD
—
165
—
123
—
103
ns
55
Address Valid Chip Select Access Time
tACSA = tcyc – tf – tDSR – tACSD
(Note 2)
tACSA
285
—
162
—
113
—
ns
56
Address Valid to Chip Select Time
tAVCS
10—10—10—
ns
57
Address Valid to Data Three-State Time
tAVDZ
—10—10—10
ns
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