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参数资料
| 型号： | ML60851DTB |
| 厂商： | LAPIS SEMICONDUCTOR CO LTD |
| 元件分类： | 总线控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP44 |
| 封装： | 10 X 10 MM, 0.80 MM PITCH, PLASTIC, TQFP-44 |
| 文件页数： | 25/84页 |
| 文件大小： | 394K |
| 代理商： | ML60851DTB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页当前第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页
FEDL60851D-01
1Semiconductor
ML60851D
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USB Bus Reset Interrupt Status:
When bit D5 of the interrupt enable register (INTENBL) is “1”, this bit
becomes “1” during a bus reset. This bit is “0” when bit D5 of INTENBL is
“0”. The value at the time of a bus reset is determined based on the value of
INTENBL.
Write a “1” in bit D5 of the device status register (DVCSTAT) to reset this
bit to “0”.
Suspend State Interrupt Status:
When bit D6 of the interrupt enable register (INTENBL) is “1”, the content
of bit D3 of the device status register (DVCSTAT) is copied here. This bit is
“0” when bit D6 of INTENBL is “0”.
EP3 Packet Ready Interrupt Status: When bit D7 of the interrupt enable register (INTENBL) is “1”, the inverted
(logical NOT) content of bit D7 of the end point packet ready register
(PKTRDY) is copied here. This bit is “0” when bit D7 of INTENBL is “0”.
The value at the time of a bus reset will be determined based on the value of
INTENBL at that time.
相关PDF资料 |
PDF描述 |
|---|---|
| ML60852A | UNIVERSAL SERIAL BUS CONTROLLER, PQFP44 |
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| ML63193-XXXWA | 4-BIT, MROM, 2 MHz, MICROCONTROLLER, UUC128 |
| ML64168-XXX | 4-BIT, MROM, 0.7 MHz, MICROCONTROLLER, UUC80 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| ML60852A | 制造商:OKI 制造商全称:OKI electronic componets 功能描述:USB Device Controller |
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