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参数资料
| 型号： | SPAKXC16Z1VFV20 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, 20 MHz, MICROCONTROLLER, PQFP144 |
| 封装： | PLASTIC, SMT-144 |
| 文件页数： | 23/200页 |
| 文件大小： | 1383K |
| 代理商： | SPAKXC16Z1VFV20 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页当前第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页
MC68HC16Z1
MOTOROLA
MC68HC16Z1TS/D
119
359
BR Asserted to BG Asserted
tBRAGA
1—
tcyc
37
BGACK Asserted to BG Negated
tGAGN
12
tcyc
39
BG Width Negated
tGH
2—
tcyc
39A
BG Width Asserted
tGA
1—
tcyc
46
R/W Width Asserted (Write or Read)
tRWA
150
—
ns
46A
R/W Width Asserted (Fast Write or Read Cycle)
tRWAS
90
—
ns
47A
Asynchronous Input Setup Time
BR, BGACK, DSACKx, BERR, AVEC, HALT
tAIST
5—
ns
47B
Asynchronous Input Hold Time
tAIHT
15
—
ns
4810
DSACKx Asserted to BERR, HALT Asserted
tDABA
—30
ns
53
Data Out Hold from Clock High
tDOCH
0—
ns
54
Clock High to Data Out High Impedance
tCHDH
—28
ns
55
R/W Asserted to Data Bus Impedance Change
tRADC
40
—
ns
70
Clock Low to Data Bus Driven (Show Cycle)
tSCLDD
029
ns
71
Data Setup Time to Clock Low (Show Cycle)
tSCLDS
15
—
ns
72
Data Hold from Clock Low (Show Cycle)
tSCLDH
10
—
ns
73
BKPT Input Setup Time
tBKST
15
—
ns
74
BKPT Input Hold Time
tBKHT
10
—
ns
75
Mode Select Setup Time
tMSS
20
—
tcyc
76
Mode Select Hold Time
tMSH
0—
ns
77
RESET Assertion Time11
tRSTA
4—
tcyc
78
RESET Rise Time12
tRSTR
—10
tcyc
100
CLKOUT High to Phase 1 Asserted13
tCHP1A
3
40
ns
101
CLKOUT High to Phase 2 Asserted13
tCHP2A
3
40
ns
102
Phase 1 Valid to AS or DS Asserted13
tP1VSA
—10
ns
103
Phase 2 Valid to AS or DS Negated13
tP2VSN
—10
ns
104
AS or DS Valid to Phase 1 Asserted13
tSAP1A
—10
ns
105
AS or DS Negated to Phase 2 Negated13
tSNP2N
—10
ns
Table 25 AC Timing (Continued)
(VDD and VDDSYN = 5.0 Vdc ± 10%, VSS = 0 Vdc, TA = TL to TH)
Num
Characteristic
Symbol
Min
Max
Unit
相关PDF资料 |
PDF描述 |
|---|---|
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| SPAKXCF333MFT20 | 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP16 |
| SPAKXCF333VFT20 | 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP16 |
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相关代理商/技术参数 |
参数描述 |
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