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参数资料
| 型号： | ST7267R8T1L/XXX |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 30 MHz, RISC MICROCONTROLLER, PQFP64 |
| 封装： | 10 X 10 MM, LEAD FREE, TQFP-64 |
| 文件页数： | 29/189页 |
| 文件大小： | 1643K |
| 代理商： | ST7267R8T1L/XXX |
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ST7267C8 ST7267R8
124/189
MSCI I/O PORTS (Cont’d)
15.3 I/O sharing between ST7 and MSCI
If MSCI I/Os are shared between the MSCI I/O
controller and the ST7 I/O controller, the MSCI
outputs are connected to alternate function of the
ST7 I/O logic and the MSCI output enable signals
are connected to the alternate enable inputs of the
ST7 I/O logic.
When ST7 configures a shared I/O in Input floating
mode, the MSCI I/O logic can directly control this I/
O.
When ST7 configures an I/O in output mode, the
MSCI can control this port in output mode by set-
ting the corresponding DDR bit because it has the
priority on I/O control. Consequently, the value on
the port is forced by the corresponding bit of the
MSCI DRO register (of port 1 or port 2). However
the MSCI can’t force this I/O to be in input mode.
Figure 52. I/O Port General Block Diagram (when MSCI I/Os are shared with ST7I/ O Logic)
DRO
DDR
DA
TA
B
U
S
VDD
ALTERNATE
OUTPUT
1
0
DDR SEL
DRI SEL
PULL-UP
CONDITION
P-BUFFER
N-BUFFER
VDD
CMOS
SCHMITT
TRIGGER
DRO SEL
ALTERNATE
ENABLE
PAD
I/O
MSCI I/O Controller
MSCI CLOCK
1
0
VDD
ST7 I/O control
See ST7 I/O control
description for more
information
ALTERNATE
OUTPUT
ALTERNATE
OUTPUT ENABLE
MSCI DDR
ST7 DDR
EFFECT ON PORT
00
Port in input mode. Can be read by
both MSCI through DRI register and
ST7 through DR register.
01
Port in output mode, value forced by
ST7 DR register.
10
Port in output mode, value forced by
MSCI DRO register.
11
Port in output mode, value forced by
MSCI DRO register.
相关PDF资料 |
PDF描述 |
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