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参数资料
| 型号： | ST72774S9T1/XXX |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | TQFP-44 |
| 文件页数： | 115/144页 |
| 文件大小： | 1280K |
| 代理商： | ST72774S9T1/XXX |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页当前第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页
ST72774/ST727754/ST72734
72/144
SYNC PROCESSOR (SYNC) (Cont’d)
HORIZONTAL SYNC GENERATOR REGISTER
(HGENR)
Read/Write
Reset Value: 0000 0000 (00h)
Case HVGEN = 1: Generation mode
In this mode, this register contains the Hsync free-
running frequency.
The generated signal is:
- Pulse width: 2 s.
- Period PH = ((HGENR+1)/4) s.
- Polarity: Positive
Note: The value in HGENR must be in the range [8..255]
.
Case HVGEN = 0: Analyzer/corrector Mode
Sub-case HACQ = 1: Analyzer Mode
By setting HACQ bit by software the Analyzer
mode starts. When HACQ is cleared by hardware,
HGENR
returns
the
duration
of
HSYNCO/
HFBACK low level. The analysis should be done
before corrector mode.
Sub-case HACQ = 0: Corrector Mode
In this mode, the final HSYNCO signal on the pin
can be corrected in order to detect and inhibit pre/
post equalization pulses.
VERTICAL
SYNC
GENERATOR
REGISTER
(VGENR)
Read/Write
Reset Value: 0000 0000 (00h)
Case HVGEN = 1: Generation mode
In this mode, this register contains the Vsync free-
running frequency (11-bit value).
The generated signal is:
- Pulse width: 4 * PH s (horizontal period).
- Period PV = PH * (V11bits) s.
- Polarity: Positive
Note: The value in VGENR must be in the range [5..255]
The Vsync generation mode works as an 11-bit hor-
izontal line counter (2047 scan lines per frame
max.). The 3 LSB are in the CFGR register. Refer
to Figure 44.
Case HVGEN = 0: Analyzer/Corrector Mode
Sub-case VACQ = 1: Analyzer Mode
Set the VACQ bit to start analyzer mode. When
VACQ is cleared by hardware, VGENR/CFGR
returns the number of scan lines during the
VSYNCO/VFBACK low level period.
Sub-case VACQ = 0: Corrector Mode
VSYNCO pulse width is extended by VGENR scan
lines. If VGENR = 0, all VSYNCO corrections are
disabled.
70
MSB
LSB
70
MSB
LSB
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