参数资料
型号: TMS320C6454ZTZ
厂商: Texas Instruments, Inc.
元件分类: 数字信号处理
英文描述: Fixed-Point Digital Signal Processor
中文描述: 定点数字信号处理器
文件页数: 124/225页
文件大小: 1663K
代理商: TMS320C6454ZTZ
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页当前第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页第225页
www.ti.com
P
1
0
0 1
DIVIDER D4
CLKIN1
(B)
PLLEN (PLLCTL.[0])
SYSREFCLK
(C64x+ MegaModule)
SYSCLK2
SYSCLK3
AECLKIN (External EMIF Clock Input)
EMIFA
DIVIDER PREDIV
/1, /2, /3
DIVIDER D2
(A)
DIVIDER D3
(A)
AECLKOUT
PLLV1
C2
C1
EMI Filter
+1.8 V
560 pF 0.1 F
SYSCLK5
(Emulation and Trace)
AECLKINSEL
(AEA[15] pin)
DIVIDER D5
/1, /2,
..., /8
PLL1 Controller
(EMIF Input Clock)
TMS320C6454 DSP
ENA
PREDEN (PREDIV.[15])
/3
/6
ENA
/2, /4,
..., /16
ENA
PLL1
PLLM
x1, x15,
x20, x25,
x30, x32
D4EN (PLLDIV4.[15])
D5EN (PLLDIV4.[15])
SYSCLK4
(Internal EMIF Clock Input)
1 0
GP1/SYSCLK4
SYSCLKOUT_EN
(AEA[4] pin)
GP0
/1, /2,
..., /8
CLKDIV
(CTRL.[18:16])
P
P
7.7.1
PLL1 Controller Device-Specific Information
TMS320C6454
Fixed-Point Digital Signal Processor
SPRS311A–APRIL 2006–REVISED DECEMBER 2006
A.
B.
DIVIDER D2 and DIVIDER D3 are always enabled.
CLKIN1 is a 3.3-V signal.
Figure 7-10. PLL1 and PLL1 Controller
7.7.1.1
Internal Clocks and Maximum Operating Frequencies
As shown in
Figure 7-10
, the PLL1 controller generates several internal clocks including the system
reference clock (SYSREFCLK), and the system clocks (SYSCLK2/3/4/5). The high-frequency clock signal
SYSREFCLK is directly used to clock the C64x+ megamodule (including the CPU) and also serves as a
reference clock for the rest of the DSP system.
Dividers D2, D3, D4, and D5 divide the high-frequency clock SYSREFCLK to generate SYSCLK2,
SYSCLK3, SYSCLK4, and SYSCLK5, respectively. The system clocks are used to clock different portions
of the DSP:
SYSCLK2 is used to clock the switched central resources (SCRs), EDMA3, as well as the data bus
interfaces of the EMIFA and DDR2 Memory Controller.
SYSCLK3 clocks the PCI, HPI, McBSP, GPIO, TIMER, and I2C peripherals, as well as the
configuration bus of the PLL2 Controller.
C64x+ Peripheral Information and Electrical Specifications
124
Submit Documentation Feedback
相关PDF资料
PDF描述
TMS320C6454ZTZ7 Fixed-Point Digital Signal Processor
TMS320C6454ZTZ8 Fixed-Point Digital Signal Processor
TMX320C6454GTZ Fixed-Point Digital Signal Processor
TMX320C6454GTZ7 Fixed-Point Digital Signal Processor
TMX320C6454GTZ8 Fixed-Point Digital Signal Processor
相关代理商/技术参数
参数描述
TMS320C6454ZTZ7 制造商:TI 制造商全称:Texas Instruments 功能描述:Fixed-Point Digital Signal Processor
TMS320C6454ZTZ8 制造商:TI 制造商全称:Texas Instruments 功能描述:Fixed-Point Digital Signal Processor
TMS320C6455 制造商:TI 制造商全称:Texas Instruments 功能描述:Fixed-Point Digital Signal Processor
TMS320C6455_07 制造商:TI 制造商全称:Texas Instruments 功能描述:Fixed-Point Digital Signal Processor
TMS320C6455BCTZ 功能描述:数字信号处理器和控制器 - DSP, DSC Fixed-Point Dig Sig Proc RoHS:否 制造商:Microchip Technology 核心:dsPIC 数据总线宽度:16 bit 程序存储器大小:16 KB 数据 RAM 大小:2 KB 最大时钟频率:40 MHz 可编程输入/输出端数量:35 定时器数量:3 设备每秒兆指令数:50 MIPs 工作电源电压:3.3 V 最大工作温度:+ 85 C 封装 / 箱体:TQFP-44 安装风格:SMD/SMT