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参数资料
| 型号： | TMS320DM365ZCE30 |
| 厂商： | Texas Instruments |
| 文件页数： | 164/210页 |
| 文件大小： | 0K |
| 描述： | IC DIGITAL MEDIA SOC 338NFBGA |
| 标准包装： | 160 |
| 系列： | TMS320DM3x, DaVinci™ |
| 类型： | 数字媒体片内系统（DMSoC） |
| 接口： | EBI/EMI，以太网，I²C，McBSP，SPI，UART，USB |
| 时钟速率： | 300MHz |
| 非易失内存： | ROM（16 kB） |
| 芯片上RAM： | 56kB |
| 电压 - 输入/输出： | 1.8V，3.3V |
| 电压 - 核心： | 1.35V |
| 工作温度： | 0°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 338-LFBGA |
| 供应商设备封装： | 338-NFBGA（13x13） |
| 包装： | 托盘 |
| 其它名称： | 296-27979 TMS320DM365ZCE30-ND |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页当前第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页
SPRS457E
– MARCH 2009 – REVISED JUNE 2011
3.3.3
PLLC1
There are two PLLs on the device, and they are independently controlled. PLLC1 generates the
frequencies needed for the ARM, Video Processing Sub System (VPSS), MJCP coprocessor block,
EDMA, and peripherals.
The reference clock for both PLLs is the single crystal input. Both PLLs will be of the same type . It should
be noted that the USB2.0 PHY contains a third PLL embedded within it. Table 3-2, and Figure 3-3
describe the customization of PLLC1.
Provides primary system clock
Software configurable
Accepts clock input or internal oscillator input
PLL pre-divider value is programmable
PLL multiplier value is programmable
PLL post-divider value is programmable . See the data manual for all supported configurations.
Only SYSCLK [9:1] are used
Table 3-2. PLLC1 Output Clocks
PLLC1SYSCLKy
Used By
PLLDIV Divider
PLLC1SYSCLK1
USB reference clock(1)
Programmable
PLLC1SYSCLK2
ARM926EJ-S, HDVICP block clock (1)
Programmable
PLLC1SYSCLK3
MJCP and HDVICP bus interface clock
Programmable
PLLC1SYSCLK4
Configuration bus clock, peripheral system interfaces,
Programmable
EDMA
PLLC1SYSCLK5
VPSS clock
Programmable
PLLC1SYSCLK6
VENC clock(1)
Programmable
PLLC1SYSCLK7
DDR 2x clock(1)
Programmable
PLLC1SYSCLK8
MMC/SD0 clock
Programmable
PLLC1SYSCLK9
CLKOUT2
Programmable
PLLC1OBSCLK
CLKOUT0
Programmable
PLLC1SYSCLKBP
USB reference clock(1)
Programmable
(1)
These clock outputs are multiplexed with other clocks.
Copyright
2009–2011, Texas Instruments Incorporated
Device Configurations
57
Product Folder Link(s): TMS320DM365
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| TMS320DM365ZCED30 | 功能描述:处理器 - 专门应用 Digital Media SOC RoHS:否 制造商:Freescale Semiconductor 类型:Multimedia Applications 核心:ARM Cortex A9 处理器系列:i.MX6 数据总线宽度:32 bit 最大时钟频率:1 GHz 指令/数据缓存: 数据 RAM 大小:128 KB 数据 ROM 大小: 工作电源电压: 最大工作温度:+ 95 C 安装风格:SMD/SMT 封装 / 箱体:MAPBGA-432 |
| TMS320DM365ZCEF | 功能描述:处理器 - 专门应用 Dig Media System- on-Chip RoHS:否 制造商:Freescale Semiconductor 类型:Multimedia Applications 核心:ARM Cortex A9 处理器系列:i.MX6 数据总线宽度:32 bit 最大时钟频率:1 GHz 指令/数据缓存: 数据 RAM 大小:128 KB 数据 ROM 大小: 工作电源电压: 最大工作温度:+ 95 C 安装风格:SMD/SMT 封装 / 箱体:MAPBGA-432 |
| TMS320DM367ZCED | 制造商:Texas Instruments 功能描述:TMS320DM367ZCEF |
| TMS320DM367ZCED30 | 制造商:Texas Instruments 功能描述:TMS320DM367ZCEF |
| TMS320DM368ZCE | 功能描述:处理器 - 专门应用 Digital Media SOC RoHS:否 制造商:Freescale Semiconductor 类型:Multimedia Applications 核心:ARM Cortex A9 处理器系列:i.MX6 数据总线宽度:32 bit 最大时钟频率:1 GHz 指令/数据缓存: 数据 RAM 大小:128 KB 数据 ROM 大小: 工作电源电压: 最大工作温度:+ 95 C 安装风格:SMD/SMT 封装 / 箱体:MAPBGA-432 |
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