参数资料
型号: TMS320DM365ZCE30
厂商: Texas Instruments
文件页数: 29/210页
文件大小: 0K
描述: IC DIGITAL MEDIA SOC 338NFBGA
标准包装: 160
系列: TMS320DM3x, DaVinci™
类型: 数字媒体片内系统(DMSoC)
接口: EBI/EMI,以太网,I²C,McBSP,SPI,UART,USB
时钟速率: 300MHz
非易失内存: ROM(16 kB)
芯片上RAM: 56kB
电压 - 输入/输出: 1.8V,3.3V
电压 - 核心: 1.35V
工作温度: 0°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 338-LFBGA
供应商设备封装: 338-NFBGA(13x13)
包装: 托盘
其它名称: 296-27979
TMS320DM365ZCE30-ND
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SPRS457E
– MARCH 2009 – REVISED JUNE 2011
the raw input image to the final processed image. This processing can be done either on-the-fly in IPIPE
or in software on the ARM and MPEG/JPEG and HD Video Image coprocessor subsystems. In parallel,
raw data input to the ISIF can also used for computing various statistics (3A, Histogram) to eventually
control the image/video tuning parameters. The ISIF is programmed via control and parameter registers.
The following features are supported by the ISIF module.
Support for conventional Bayer pattern, pixel summation mode, and RGB stripe sensor formats.
Support for the various pixel summation mode formats is provided via a data reformatter of ISIF, which
transforms any specific sensor formats to the Bayer format. The maximum line width supported by the
reformatter is 4736 pixels.
Image processing steps applicable to RGB stripe sensors are limited to color-dependent gain control
and black level offset control."
Generates HD/VD timing signals and field ID to an external timing generator, or can synchronize to the
external timing generator.
Support for progressive and interlaced sensors (hardware support for up to 2 fields and firmware
support for higher number of fields, typically 3-, 4-, and 5-field sensors.
Support for up to 32K pixels (image size) in both the horizontal and vertical direction.
Support for up to 120 MHz sensor clock.
Support for ITU-R BT.656/1120 standard format.
Support for YCbCr 422 format, either 8- or 16-bit with discrete HSYNC and VSYNC signals.
Support for up to 16-bit input.
Support for color space conversion.
Digital clamp with Horizontal/Vertical offset drift compensation.
Vertical Line defect correction based on a lookup table that contains defect position.
Support for color-dependent gain control and black level offset control.
Ability to control output to the DDR2/mDDR via an external write enable signal.
Support for down sampling via programmable culling patterns.
Support for 12-bit to 8-bit DPCM compression.
Support for 10-bit to 8-bit A-law compression.
Support for generating output to range 16-bits, 12-bits, and 8-bits wide (8-bits wide allows for 50%
saving in storage area).
OTF DPC
Noise Filter
2D edge enhancement
The ISIF register memory mapping (offsets) is shown in Table 6-40.
Table 6-40. Image Sensor Interface (ISIF) Registers
Offset
Acronym
Register Description
0h
SYNCEN
Synchronization Enable
4h
MODESET
Mode Setup
8h
HDW
HD pulse width
Ch
VDW
VD pulse width
10h
PPLN
Pixels per line
14h
LPFR
Lines per frame
18h
SPH
Start pixel horizontal
1Ch
LNH
Number of pixels in line
20h
SLV0
Start line vertical - field 0
24h
SLV1
Start line vertical - field 1
28h
LNV
Number of lines vertical
124
Peripheral Information and Electrical Specifications
Copyright
2009–2011, Texas Instruments Incorporated
Product Folder Link(s): TMS320DM365
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