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参数资料
| 型号： | TMS320DM365ZCE30 |
| 厂商： | Texas Instruments |
| 文件页数： | 53/210页 |
| 文件大小： | 0K |
| 描述： | IC DIGITAL MEDIA SOC 338NFBGA |
| 标准包装： | 160 |
| 系列： | TMS320DM3x, DaVinci™ |
| 类型： | 数字媒体片内系统（DMSoC） |
| 接口： | EBI/EMI，以太网，I²C，McBSP，SPI，UART，USB |
| 时钟速率： | 300MHz |
| 非易失内存： | ROM（16 kB） |
| 芯片上RAM： | 56kB |
| 电压 - 输入/输出： | 1.8V，3.3V |
| 电压 - 核心： | 1.35V |
| 工作温度： | 0°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 338-LFBGA |
| 供应商设备封装： | 338-NFBGA（13x13） |
| 包装： | 托盘 |
| 其它名称： | 296-27979 TMS320DM365ZCE30-ND |
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VCLK
(Positive Edge
Clocking)
VCLK
(Negative Edge
Clocking)
17
VCTL(B)
VDATA(C)
19
18
22
21
23
24
25
26
VCLKIN(A)
A.
B. VCTL = HSYNC, VSYNC, FIELD, and LCD_OE
C. VDATA = COUT[7:0], YOUT[7:0], R[7:0], G[7:0], and B[7:0]
20
VCLKIN = PCLK or EXTCLK. Note Positive and Negative edge apply for PCLK only, EXTCLK does not support negative edge clocking.
SPRS457E
– MARCH 2009 – REVISED JUNE 2011
Table 6-55. Switching Characteristics Over Recommended Operating Conditions for VPBE Control and
DEVICE
NO.
PARAMETER
UNIT
MIN
MAX
17
tc(VCLK)
Cycle time, VCLK
13.33
160
ns
18
tw(VCLKH)
Pulse duration, VCLK high
5.7
ns
19
tw(VCLKL)
Pulse duration, VCLK low
5.7
ns
20
tt(VCLK)
Transition time, VCLK
3
ns
21
td(VCLKINH-VCLKH)
Delay time, VCLKIN high to VCLK high
3
16
ns
22
td(VCLKINL-VCLKL)
Delay time, VCLKIN low to VCLK low
3
16
ns
23
td(VCLK-VCTLV)
Delay time, VCLK edge to VCTL valid
1.5
ns
24
td(VCLK-VCTLIV)
Delay time, VCLK edge to VCTL invalid
-1.5
ns
25
td(VCLK-VDATAV)
Delay time, VCLK edge to VDATA valid
1.5
ns
26
td(VCLK-VDATAIV)
Delay time, VCLK edge to VDATA invalid
-1.5
ns
(1)
The VPBE may be configured to operate in either positive or negative edge clocking mode. When in positive edge clocking mode, the
rising edge of VCLK is referenced. When in negative edge clocking mode, the falling edge of VCLK is referenced.
(2)
VCLKIN = PCLK or EXTCLK. Positive and Negative edge apply for PCLK only, EXTCLK does not support negative edge clocking. For
timing specifications relating to PCLK, see Table 6-45, Timing Requirements for VPFE PCLK Master/Slave Mode.
(3)
VCTL= HSYNC, VSYNC, FIELD and LCD_OE.
Figure 6-38. VPBE Control and Data Output Timing With Respect to VCLK
6.12.2.4 High-Definition (HD) DACs and Video Buffer Electrical Data/Timing
Three DACs and a video buffer are available on the device.
6.12.2.4.1 HD DACs-Only Option
In the HD DACs-only configuration, the internal video buffer is not used and an external video buffer is
attached to the DACs. Another solution is to use a Video Amplifier, such as the Texas Instruments'
THS7303 which provides a complete solution to the typical output circuit shown in Figure 6-39.
Note: HD display mode resolutions are not supported on ARM 216MHz clock rate devices.
146
Peripheral Information and Electrical Specifications
Copyright
2009–2011, Texas Instruments Incorporated
Product Folder Link(s): TMS320DM365
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PDF描述 |
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参数描述 |
|---|---|
| TMS320DM365ZCED30 | 功能描述:处理器 - 专门应用 Digital Media SOC RoHS:否 制造商:Freescale Semiconductor 类型:Multimedia Applications 核心:ARM Cortex A9 处理器系列:i.MX6 数据总线宽度:32 bit 最大时钟频率:1 GHz 指令/数据缓存: 数据 RAM 大小:128 KB 数据 ROM 大小: 工作电源电压: 最大工作温度:+ 95 C 安装风格:SMD/SMT 封装 / 箱体:MAPBGA-432 |
| TMS320DM365ZCEF | 功能描述:处理器 - 专门应用 Dig Media System- on-Chip RoHS:否 制造商:Freescale Semiconductor 类型:Multimedia Applications 核心:ARM Cortex A9 处理器系列:i.MX6 数据总线宽度:32 bit 最大时钟频率:1 GHz 指令/数据缓存: 数据 RAM 大小:128 KB 数据 ROM 大小: 工作电源电压: 最大工作温度:+ 95 C 安装风格:SMD/SMT 封装 / 箱体:MAPBGA-432 |
| TMS320DM367ZCED | 制造商:Texas Instruments 功能描述:TMS320DM367ZCEF |
| TMS320DM367ZCED30 | 制造商:Texas Instruments 功能描述:TMS320DM367ZCEF |
| TMS320DM368ZCE | 功能描述:处理器 - 专门应用 Digital Media SOC RoHS:否 制造商:Freescale Semiconductor 类型:Multimedia Applications 核心:ARM Cortex A9 处理器系列:i.MX6 数据总线宽度:32 bit 最大时钟频率:1 GHz 指令/数据缓存: 数据 RAM 大小:128 KB 数据 ROM 大小: 工作电源电压: 最大工作温度:+ 95 C 安装风格:SMD/SMT 封装 / 箱体:MAPBGA-432 |
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