参数资料
型号: TMS320DM647ZUT7
厂商: Texas Instruments
文件页数: 177/190页
文件大小: 0K
描述: IC DGTL MEDIA PROC 529-FCBGA
标准包装: 84
系列: TMS320DM64x, DaVinci™
类型: 定点
接口: 主机接口,I²C,McASP,PCI,SPI,UART
时钟速率: 720MHz
非易失内存: ROM(64 kB)
芯片上RAM: 320kB
电压 - 输入/输出: 1.8V,3.3V
电压 - 核心: 1.20V
工作温度: 0°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 529-BFBGA,FCBGA
供应商设备封装: 529-FCBGA(19x19)
包装: 托盘
其它名称: 296-34539-5
TMS320DM647ZUT7-ND
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SPRS372H – MAY 2007 – REVISED APRIL 2012
6.7.7
Reset Controller Register
The reset type status (RSTYPE) register is the only register for the reset controller.
The RSTYPE register latches the cause of the last reset. If multiple reset sources occur simultaneously,
this register latches the highest priority reset source. The reset type status register is shown in Figure 6-9
and described in Table 6-22.
Figure 6-9. Reset Type Status Register (RSTYPE)
31
16
Reserved
R-0
15
4
3
2
1
0
Reserved
SRST
MRST
WRST
POR
R-0
LEGEND: R/W = Read/Write; R = Read only; -n = value after reset
Table 6-22. Reset Type Status Register (RSTYPE) Field Descriptions
Bit
Field
Value
Description
31:4
Reserved
Reserved. The reserved bit location is always read as 0. A value written to this field has no effect.
3
SRST
System reset
0
System Reset was not the last reset to occur.
1
System Reset was the last reset to occur.
2
MRST
Max reset
0
Max Reset was not the last reset to occur.
1
Max Reset was the last reset to occur.
1
WRST
Warm reset
0
Warm Reset was not the last reset to occur.
1
Warm Reset was the last reset to occur.
0
POR
Power-on reset
0
Power-on Reset was not the last reset to occur.
1
Power-on Reset was the last reset to occur.
6.7.8
Pin Behaviors at Reset
During normal operation, devices pins are controlled by the selected peripheral. During device level global
reset, the pin behaviors are classified into the following Reset Groups:
Z Group: These pins are 3-stated when a device-level global reset source (e.g., POR, RESET, or Max
Reset) is asserted. When the reset source is de-asserted, these pins remain 3-stated until configured
otherwise by their respective peripheral (after the peripheral is enabled by the PSC).
Z/High Group: These pins are 3-stated when a device-level global reset source (e.g., POR, RESET,
or Max Reset) is asserted. When the reset source is de-asserted, these pins drive a logic High.
Z/Low Group: These pins are 3-stated when a device-level global reset source (e.g. POR, RESET, or
Max Reset) is asserted. When the reset source is de-asserted, these pins drive a logic Low.
DDR2 Z/High Group: These pins are 3-stated when a device-level global reset source (e.g. POR,
RESET, or Max Reset) is asserted. When the reset source is de-asserted, these pins are Driven High.
DDR2 Low/High Group: These pins are driven Low when a device-level global reset source (e.g.
POR, RESET, or Max Reset) is asserted. When the reset source is de-asserted, these pins are Driven
High.
DDR2 High/Low Group: These pins are driven High when a device-level global reset source (e.g.
POR, RESET, or Max Reset) is asserted. When the reset source is de-asserted, these pins are Driven
Low.
Copyright 2007–2012, Texas Instruments Incorporated
Peripheral Information and Electrical Specifications
87
Product Folder Link(s): TMS320DM647 TMS320DM648
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