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参数资料
| 型号： | TMX320C6203CGNZ |
| 厂商： | TEXAS INSTRUMENTS INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | 32-BIT, 300 MHz, OTHER DSP, PBGA352 |
| 封装： | PLASTIC, BGA-352 |
| 文件页数： | 22/101页 |
| 文件大小： | 1470K |
| 代理商： | TMX320C6203CGNZ |
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TMS320C6203B, TMS320C6203C
FIXEDPOINT DIGITAL SIGNAL PROCESSORS
SPRS086G – JANUARY 1999 – REVISED JANUARY 2002
27
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
Signal Descriptions (Continued)
SIGNAL
PIN NO.
SIGNAL
NAME
GNZ
GLS/
GNY
TYPE
DESCRIPTION
MULTICHANNEL BUFFERED SERIAL PORT 0 (McBSP0)
CLKS0
M4
K3
I
External clock source (as opposed to internal)
CLKR0
M2
L2
I/O/Z
Receive clock
CLKX0
M3
K1
I/O/Z
Transmit clock
DR0
R2
M2
I
Receive data
DX0
P4
M3
O/Z
Transmit data
FSR0
N3
M1
I/O/Z
Receive frame sync
FSX0
N4
L3
I/O/Z
Transmit frame sync
MULTICHANNEL BUFFERED SERIAL PORT 1 (McBSP1)
CLKS1
G1
E1
I
External clock source (as opposed to internal)
CLKR1
J3
G2
I/O/Z
Receive clock
CLKX1
H2
G3
I/O/Z
Transmit clock
DR1
L4
H1
I
Receive data
DX1
J1
H2
O/Z
Transmit data
FSR1
J2
H3
I/O/Z
Receive frame sync
FSX1
K4
G1
I/O/Z
Transmit frame sync
MULTICHANNEL BUFFERED SERIAL PORT 2 (McBSP2)
CLKS2
R3
N1
I
External clock source (as opposed to internal)
CLKR2
T2
N2
I/O/Z
Receive clock
CLKX2
R4
N3
I/O/Z
Transmit clock
DR2
V1
R2
I
Receive data
DX2
T4
R1
O/Z
Transmit data
FSR2
U2
P3
I/O/Z
Receive frame sync
FSX2
T3
P2
I/O/Z
Transmit frame sync
RESERVED FOR TEST
RSV0
L3
J2
I
Reserved for testing, pullup with a dedicated 20-k
resistor
RSV1
G3
E3
I
Reserved for testing, pullup with a dedicated 20-k
resistor
RSV2
A12
B11
I
Reserved for testing, pullup with a dedicated 20-k
resistor
RSV3
C15
B13
O
Reserved (leave unconnected, do not connect to power or ground)
RSV4
D12
C10
O
Reserved (leave unconnected, do not connect to power or ground)
I = Input, O = Output, Z = High Impedance, S = Supply Voltage, GND = Ground
PRODUCT
PREVIEW
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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