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参数资料
| 型号： | TMX320C6203CGNZ |
| 厂商： | TEXAS INSTRUMENTS INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | 32-BIT, 300 MHz, OTHER DSP, PBGA352 |
| 封装： | PLASTIC, BGA-352 |
| 文件页数： | 79/101页 |
| 文件大小： | 1470K |
| 代理商： | TMX320C6203CGNZ |
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TMS320C6203B, TMS320C6203C
FIXEDPOINT DIGITAL SIGNAL PROCESSORS
SPRS086G – JANUARY 1999 – REVISED JANUARY 2002
79
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
EXPANSION BUS ASYNCHRONOUS HOST-PORT TIMING
timing requirements with external device as asynchronous bus master (see Figure 42 and
Figure 43)
NO.
C6203B-250
C6203B-300
C6203C-300
UNIT
NO.
MIN
MAX
MIN
MAX
UNIT
1
tw(XCSL)
Pulse duration, XCS low
4P
ns
2
tw(XCSH)
Pulse duration, XCS high
4P
ns
3
tsu(XSEL-XCSL)
Setup time, expansion bus select signals valid before XCS
low
1
2
ns
4
th(XCSL-XSEL)
Hold time, expansion bus select signals valid after XCS low
3.4
2
ns
10
th(XRYL-XCSL)
Hold time, XCS low after XRDY low
P + 1.5
P
ns
11
tsu(XBEV-XCSH)
Setup time, XBE[3:0]/XA[5:2] valid before XCS high§
1
2
ns
12
th(XCSH-XBEV)
Hold time, XBE[3:0]/XA[5:2] valid after XCS high§
3
2
ns
13
tsu(XDV-XCSH)
Setup time, XDx valid before XCS high
1
2
ns
14
th(XCSH-XDV)
Hold time, XDx valid after XCS high
3
2
ns
P = 1/CPU clock frequency in ns. For example, when running parts at 300 MHz, use P = 3.3 ns.
Expansion bus select signals include XCNTL and XR/W.
§ XBE[3:0]/XA[5:2] operate as byte-enables XBE[3:0] during host-port accesses.
switching characteristics over recommended operating conditions with external device as
asynchronous bus master (see Figure 42 and Figure 43)
NO.
PARAMETER
C6203B-250
C6203B-300
C6203C-300
UNIT
NO.
PARAMETER
MIN
MAX
MIN
MAX
UNIT
5
td(XCSL-XDLZ)
Delay time, XCS low to XDx low impedance
0
ns
6
td(XCSH-XDIV)
Delay time, XCS high to XDx invalid
0
12
0
12
ns
7
td(XCSH-XDHZ)
Delay time, XCS high to XDx high impedance
4P
ns
8
td(XRYL-XDV)
Delay time, XRDY low to XDx valid
–4
1
0
4
ns
9
td(XCSH-XRYH)
Delay time, XCS high to XRDY high
0
12
0
12
ns
P = 1/CPU clock frequency in ns. For example, when running parts at 300 MHz, use P = 3.3 ns.
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