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参数资料
| 型号： | ZPSD813F3V-20J |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 1M X 1 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQCC52 |
| 封装： | PLASTIC, LDCC-52 |
| 文件页数： | 62/132页 |
| 文件大小： | 513K |
| 代理商： | ZPSD813F3V-20J |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页当前第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页
Preliminary
PSD813F Family
31
The
PSD813F
Functional
Blocks
(cont.)
Level 1
SRAM, I /O, or
Peripheral I /O
Level 2
EEPROM / Flash Boot
Memory
Highest Priority
Lowest Priority
Level 3
Flash Memory
Figure 7. Priority Level of Memory and I/O Components
9.1.3.1. Memory Select Configuration for MCUs with Separate Program and Data Spaces
The 8031 and compatible family of microcontrollers, which includes the 80C51, 80C151,
80C251, and 80C51XA, have separate address spaces for code memory (selected using
PSEN) and data memory (selected using RD). Any of the memories within the PSD813F
can reside in either space or both spaces. This is controlled through manipulation of the VM
register that resides in the PSD’s CSIOP space.
The VM register is set using PSDsoft to have an initial value. It can subsequently be
changed by the microcontroller so that memory mapping can be changed on-the-fly.
For example, I may wish to have SRAM and Flash in Data Space at boot, and EEPROM in
Program Space at boot, and later swap EEPROM and Flash. This is easily done with
the VM register by using PSDsoft Configuration to configure it for boot up and having the
microcontroller change it when desired.
Table 13 describes the VM Register.
Bit 7
Bit 6* Bit 5*
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
PIO_EN
FL_Data EE_Data
FL_Code
EE_Code SRAM_Code
0 = disable
**
0 = RD
0 = PSEN
PIO mode
can’t
access
Flash
EEPROM/
Flash
EEPROM/
SRAM
Boot Flash
1= enable
**
1 = RD
1 = PSEN
PIO mode
access
Flash
EEPROM/
Flash
EEPROM/
SRAM
Boot Flash
Table 13. VM Register
NOTE: Bits 6-5 are not used.
相关PDF资料 |
PDF描述 |
|---|---|
| ZDVG10A | 7 SEG NUMERIC DISPLAY, GREEN, 10.16 mm |
| ZMG75W | SINGLE COLOR LED, GREEN, 2.3 mm |
| ZMGUY62M-01 | DUAL COLOR LED |
| Z505 | INTERCONNECTION DEVICE |
| Z410 | INTERCONNECTION DEVICE |
相关代理商/技术参数 |
参数描述 |
|---|---|
| ZPSD813F3V-A-15J | 制造商:WSI 功能描述: |
| ZPSD813F4-12JI | 制造商:WSI 功能描述: |
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