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参数资料
| 型号： | 935263912557 |
| 厂商： | NXP SEMICONDUCTORS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 1 CHANNEL(S), 400M bps, SERIAL COMM CONTROLLER, PQFP100 |
| 封装： | 14 X 14 MM, 1 MM HEIGHT, PLASTIC, SOT-386-1, TQFP-100 |
| 文件页数： | 40/56页 |
| 文件大小： | 277K |
| 代理商： | 935263912557 |
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Philips Semiconductors
Preliminary specification
PDI1394L21
1394 full duplex AV link layer controller
2000 Jun 06
45
14.1
Pin Categories
Table 11.
Pin Categories
Category 1:
Input/Output
Category 2:
Input
Category 3:
Input
Category 4:
Output
Category 5:
Output
Category 6:
Input/Output
Category 7:
Category 8:
HIF D[7:0]
HIF A[8:0]
RESET_N
CYCLEOUT
HIF INT_N
PHY D[0:7]
LREQ
SCLK
AVxSYNC
HIF CS_N
CYCLEIN
AVxERR0
PHY CTL[0:1]
AVxVALID
HIF WR_N
ISO_N
AVxERR1
AV xD[7:0]
HIF RD_N
CLK25
AVxENKEY
AVxENDPCK
AVxCLK
AVxFSYNC
15.0
AC CHARACTERISTICS
GND = 0V, CL = 50pF
LIMITS
SYMBOL
PARAMETER
TEST CONDITIONS
WAVEFORMS
Tamb = 0°C to +70°C
UNIT
MIN
TYP
MAX
tPERIOD
AV clock period
Figure 26
41.67
ns
tSU
AV clock setup time
Figure 26
20
ns
tIH
AV clock input hold time
Figure 26
3
ns
tOD
AV clock output delay time
Figure 26
3
24
ns
tWHIGH
AV clock pulse width HIGH
Figure 26
10
tWLOW
AV clock pulse width LOW
Figure 26
10
tPWFS
AVxFSYNC pulse width HIGH
Figure 27
100
140
ns
tSUP
PHY-link setup time
Figure 28
6.0
ns
tHP
PHY-link hold time
Figure 28
0
ns
tSCLKPER
SCLK period
Figure 28
20.343
20.345
20.347
ns
tDP
PHY-link output delay
Note: CL = 20pF
Figure 29
2.0
10.0
ns
tAS
Host address setup time
Figure 30
0
ns
tAH
Host address hold time
Figure 30
0
ns
tCL
Host chip select pulse width LOW
Figure 30
115
ns
tCH
Host chip select pulse width HIGH
Figure 30
42
ns
tRP
Host read pulse width
Figure 30
115
ns
tACC
Host access time
Figure 30
115
ns
tDH
Host data hold time
Figure 30
0
ns
tDS
Host data setup time
Figure 30
0
ns
tDZ
Host data bus release (Hi-Z)
Figure 30
15
ns
tWRP
Host write pulse width
Figure 30
115
ns
tCWH
CYCLEIN HIGH pulse width
Figure 31
200
ns
tCWL
CYCLEIN LOW pulse width
Figure 31
200
ns
tCP
CYCLEIN cycle period
Figure 31
125
s
tCD
CYCLEOUT cycle delay
Figure 32
20
ns
tRESET
RESET_N pulse width LOW
Figure 33
10
s
相关PDF资料 |
PDF描述 |
|---|---|
| 935263912551 | 1 CHANNEL(S), 400M bps, SERIAL COMM CONTROLLER, PQFP100 |
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参数描述 |
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