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参数资料
| 型号： | AD6634 |
| 厂商： | Analog Devices, Inc. |
| 元件分类： | 基带处理器 |
| 英文描述： | 80 MSPS, Dual-Channel WCDMA Receive Signal Processor (RSP) |
| 中文描述： | 80 MSPS的双通道的WCDMA接收信号处理器（RSP） |
| 文件页数： | 44/52页 |
| 文件大小： | 925K |
| 代理商： | AD6634 |
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REV. 0
–44–
AD6634
Table XV. Memory Map for Output Port Control Registers (continued)
Channel
Address
Bit
Width
Register
Comments
16
17
18
AGC B Loop Gain
AGC B Pole Location
AGC B Average Samples
8
8
6
7–0:
7–0:
5–2:
1–0:
11–0: CIC Decimation
7–6:
Reserved
5:
Parallel Port Data Format
1:
8-Bit Parallel I, Q
0:
16-Bit Interleaved I, Q
4:
Channel 3
3:
Channel 2
2:
Channel 1/AGC B Enable
1:
Channel 0/AGC A Enable
0:
AGC_CH Select
1:
Data Comes from AGCs
0:
Data Comes from Channels
7:
Link Port A Enable
6–3:
Wait
2:
No RSSI Word
1:
Don’t Output RSSI Word
0:
Output RSSI Word
1:
Channel Data Interleaved
1:
2-Channel Mode/Separate AB
0:
4-Channel Mode/AB Same Port
0:
AGC_CH Select
1:
Data Comes from AGCs
0:
Data Comes from Channels
7–6: Reserved
5:
Parallel Port Data Format
1:
8-Bit Parallel I, Q
0:
16-Bit Interleaved I, Q
4:
Channel 3
3:
Channel 2
2:
Channel 1/AGC B Enable
1:
Channel 0/AGC A Enable
0:
AGC_CH Select
1:
Data Comes from AGCs
0:
Data Comes from Channels
7:
Link Port B Enable
6–3:
Wait
2:
No RSSI Word
1:
Don’t Output RSSI Word
0:
Output RSSI Word
1:
Channel Data Interleaved
1:
2-Channel Mode/Separate AB
0:
4-Channel Mode/AB Same Port
0:
AGC_CH Select
1:
Data Comes from AGCs
0:
Data Comes from Channels
2–1:
PCLK Divisor
0:
PCLK Master/Slave
*
0:
Slave
1:
Master
K Parameter
P Parameter
Scale for CIC Decimator
Number of Averaging Samples
19
1A
AGC B Update Decimation
Parallel A Control
12
8
1B
Link A Control
8
1C
Parallel B Control
8
1D
Link B Control
8
1E
Port Clock Control
3
*
PCLK boots as slave.
相关PDF资料 |
PDF描述 |
|---|---|
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参数描述 |
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