参数资料
| 型号： | ADM1060ARU |
| 厂商： | Analog Devices Inc |
| 文件页数： | 34/52页 |
| 文件大小： | 0K |
| 描述： | IC SUPERVIS/SEQUENC 7-CH 28TSSOP |
| 标准包装： | 50 |
| 系列： | Super Sequencer® |
| 类型： | 序列发生器 |
| 监视电压数目： | 7 |
| 输出： | 可编程 |
| 电压 - 阀值： | 可调节/可选择 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 28-TSSOP |
| 包装： | 管件 |
| 配用： | EVAL-ADM1060EBZ-ND - BOARD EVALUATION ADM1060 |
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ADM1060
Table 39. Programmable Driver Outputs Registers
Default
Hex
Power-On
Address
0D
Table
Name
P1PDOCFG
Value
0x00
Description
Selects the format of the PDO1 output (open drain, open drain with internal
pull-up, charge pumped, etc.).
1D
P2PDOCFG
0x00
Selects the format of the PDO2 output (open drain, open drain with internal
pull-up, charge pumped, etc.).
2D
P3PDOCFG
0x00
Selects the format of the PDO3 output (open drain, open drain with internal
pull-up, charge pumped, etc.).
3D
P4PDOCFG
0x00
Selects the format of the PDO4 output (open drain, open drain with internal
pull-up, charge pumped, etc.).
4D
P5PDOCFG
0x00
Selects the format of the PDO5 output (open drain, open drain with internal
pull-up, etc.). Note: charge pumped output is not available on this driver.
5D
P6PDOCFG
0x00
Selects the format of the PDO6 output (open drain, open drain with internal
pull-up, etc.). Note: charge pumped output is not available on this driver.
6D
P7PDOCFG
0x00
Selects the format of the PDO7 output (open drain, open drain with internal
pull-up, etc.). Note: charge pumped output is not available on this driver.
7D
P8PDOCFG
0x00
Selects the format of the PDO8 output (open drain, open drain with internal
pull-up etc.). Note: charge pumped output is not available on this driver.
8D
P9PDOCFG
0x00
Selects the format of the PDO9 output (open drain, open drain with internal
pull-up, etc.). Note: charge pumped output is not available on this driver.
Table 40. PnPDOCFG Register 0x0D, 0x1D, 0x2D, 0x3D, 0x4D, 0x5D, 0x6D, 0x7D, 0x8D (Power-On Default 0x00)
Bit
7
6–4
Name
Reserved
CFG6–CFG4
R/W
N/A
R/W
Description
Cannot Be Used
Controls the logical state of the PDO. These three bits determine what effect, if any, the logi-
cal input to the PDO has on its output.
CFG6 CFG5 CFG4 PDO State
0 0 0 0 Disabled, with weak pull-down
0 0 1 PLB_OUT Enabled, follows PLB logic output
0 1 0 0 Enables SMBus data, drive low
0 1 1 1 Enables SMBus data, drive high
1 X X MCLK Enables MCLK out onto pin
3–0
CFG3–CFG0
R/W
CFG3 CFG2 CFG1 CFG0 Pull-Up Supply Pull-Up Strength
0 0 0 X none N/A
0 0 1 X VCP 300 k?
0 1 0 0 VP1 Low
0 1 0 1 VP1 High
0 1 1 0 VP2 Low
0 1 1 1 VP2 High
1 0 0 0 VP3 Low
1 0 0 1 VP3 High
1 0 1 0 VP4 Low
1 0 1 1 VP4 High
1 1 1 0 V DD
1 1 1 1 V DD
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Low
High
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