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参数资料
| 型号： | ADP1043A-USB-Z |
| 厂商： | Analog Devices Inc |
| 文件页数： | 50/72页 |
| 文件大小： | 0K |
| 描述： | EVAL BOARD DIG POWER SUPPLY |
| 标准包装： | 1 |
| 附件类型： | 连接 USB 至 I2C 的接收器 |
| 适用于相关产品： | ADP1043A |
| 相关产品： | ADP1043AACPZ-RLDKR-ND - IC SECONDARY SIDE CTRLR 32LFCSP ADP1043AACPZ-RLCT-ND - IC SECONDARY SIDE CTRLR 32LFCSP ADP1043AACPZ-RLTR-ND - IC SECONDARY SIDE CTRLR 32LFCSP |
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ADP1043A
PWM AND SYNCHRONOUS RECTIFIER TIMING REGISTERS
Figure 36 and Table 58 to Table 88 describe the implementation and programming of the seven PWM signals that are output from the
ADP1043A. In general, it is recommended that t 1 be set to 0 and that t 1 be set as the reference point for the other signals.
t 2
PWM1 (OUTA)
t 1
t 4
PWM2 (OUTB)
t 3
t 5
PWM3 (OUTC)
PWM4 (OUTD)
SYNC RECT 1 (SR1)
SYNC RECT 2 (SR2)
PWM5 (OUTAUX)
t 12
t 13
t 6
t 11
t 14
t 7
t 10
t 8
t 9
t PERIOD
Figure 36. PWM Timing Diagram
Table 58. Register 0x3F—OUTAUX Switching Frequency Setting
t PERIOD
Bits
[7:6]
[5:0]
Name
Reserved
Switching frequency
R/W
R/W
R/W
Description
Reserved.
This register sets the switching frequency of the OUTAUX signal.
Bit 5
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
Bit 4
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
1
1
1
1
1
Bit 3
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
0
0
0
0
0
Bit 2
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
0
0
0
1
Bit 1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
Bit 0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
Frequency (kHz)
48.8
50.4
52.0
53.8
55.8
57.9
60.1
62.5
65.1
67.9
71.0
74.4
78.1
82.2
86.8
91.9
97.6
100.8
104.1
107.7
111.6
Rev. 0 | Page 50 of 72
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