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参数资料
| 型号： | ADP1043A-USB-Z |
| 厂商： | Analog Devices Inc |
| 文件页数： | 58/72页 |
| 文件大小： | 0K |
| 描述： | EVAL BOARD DIG POWER SUPPLY |
| 标准包装： | 1 |
| 附件类型： | 连接 USB 至 I2C 的接收器 |
| 适用于相关产品： | ADP1043A |
| 相关产品： | ADP1043AACPZ-RLDKR-ND - IC SECONDARY SIDE CTRLR 32LFCSP ADP1043AACPZ-RLCT-ND - IC SECONDARY SIDE CTRLR 32LFCSP ADP1043AACPZ-RLTR-ND - IC SECONDARY SIDE CTRLR 32LFCSP |
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ADP1043A
Table 89. Register 0x5E—Password Lock
Bits
[7:0]
Name
Password
R/W
W
Description
This register contains the 8-bit EEPROM lock password. This password is used to protect the
register contents from being changed. The EEPROM is always locked. When the EEPROM
downloads its contents to the registers, the password is also downloaded. If the user writes the
same password to this register twice, the EEPROM is unlocked and can be updated. To lock the
EEPROM again, the user must write any value other than the password value into this register.
DIGITAL FILTER PROGRAMMING REGISTERS
POLE
ZERO
100Hz
500Hz
1kHz
5kHz
10kHz
POLE LOCATION RANGE
Figure 37. Digital Filter Programmability
Table 90. Register 0x5F—Soft Start Digit al Filter LF Gain Setting
Bits
[7:2]
[1:0]
Name
Reserved
Soft start filter gain
R/W
R/W
R/W
Description
Reserved.
These bits set the gain of the low-pass digital filter that is used during soft start.
Bit 1
Bit 0
Filter Gain
0
0
1
0
1
2
1
0
4
1
1
8
Table 91. Register 0x60—Normal Mode Digital Filter LF Gain Setting
Bits
[7:0]
Name
LF gain setting
R/W
R/W
Description
This register determines the low frequency gain of the loop response. Programmable over a
Table 92. Register 0x61—Normal Mode Digital Filter Zero Setting
Bits
[7:0]
Name
Zero setting
R/W
R/W
Description
Table 93. Register 0x62—Normal Mode Digital Filter Pole Setting
Bits
[7:0]
Name
Pole location
R/W
R/W
Description
Rev. 0 | Page 58 of 72
相关PDF资料 |
PDF描述 |
|---|---|
| VE-2TZ-EX | CONVERTER MOD DC/DC 2V 30W |
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| 202D232-4-61/42-0 | BOOT MOLDED |
| VE-2TZ-EW | CONVERTER MOD DC/DC 2V 40W |
| GSM06DREF | CONN EDGECARD 12POS .156 EYELET |
相关代理商/技术参数 |
参数描述 |
|---|---|
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